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CY7C026A-20AXCT PDF预览

CY7C026A-20AXCT

更新时间： 2024-09-18 19:49:15
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 静态存储器内存集成电路
页数 文件大小 规格书
18页 315K
描述
Multi-Port SRAM, 16KX16, 20ns, CMOS, PQFP100, LEAD FREE, PLASTIC, MS-026, TQFP-100

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CY7C026A-20AXCT 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete包装说明：LFQFP, QFP100,.63SQ,20
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.32.00.41风险等级：5.83
最长访问时间：20 nsI/O 类型：COMMON
JESD-30 代码：S-PQFP-G100JESD-609代码：e3
长度：14 mm内存密度：262144 bit
内存集成电路类型：MULTI-PORT SRAM内存宽度：16
湿度敏感等级：3功能数量：1
端口数量：2端子数量：100
字数：16384 words字数代码：16000
工作模式：ASYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：16KX16
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：LFQFP封装等效代码：QFP100,.63SQ,20
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE, FINE PITCH
并行/串行：PARALLEL峰值回流温度（摄氏度）：260
电源：5 V认证状态：Not Qualified
座面最大高度：1.6 mm最大待机电流：0.0015 A
最小待机电流：2 V子类别：SRAMs
最大压摆率：0.275 mA最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：14 mmBase Number Matches：1

CY7C026A-20AXCT 数据手册

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CY7C026A/026B  
CY7C036A16K  
x
16/18 Dual-Port Static RAM  
CY7C026A/026B  
CY7C036A  
16K x 16/18 Dual-Port Static RAM  
■
■
Automatic power down  
Features  
Expandable data bus to 32/36 bits or more using Master/Slave  
chip select when using more than one device  
■
True dual-ported memory cells that allow simultaneous access  
of the same memory location  
■
■
On-chip arbitration logic  
■
■
■
■
■
■
■
■
16K x 16 organization (CY7C026A/026B[1]  
)
Semaphores included to permit software handshaking  
between ports  
16K x 18 organization (CY7C036A)  
0.35 micron CMOS for optimum speed and power  
High speed access: 12[2], 15, and 20 ns  
Low operating power  
■
■
■
■
■
■
INT flags for port-to-port communication  
Separate upper-byte and lower-byte control  
Pin select for Master or Slave  
Active: ICC = 180 mA (typical)  
Commercial and Industrial temperature ranges  
Available in 100-Pin TQFP  
Standby: ISB3 = 0.05 mA (typical)  
Fully asynchronous operation  
Pb-free packages available  
Logic Block Diagram  
R/WL  
UBL  
R/WR  
UBR  
CEL  
CER  
LBL  
LBR  
OEL  
OER  
8/9  
8/9  
[3]  
[3]  
I/O8/9L–I/O15/17L  
I/O8/9L–I/O15/17R  
8/9  
8/9  
I/O  
Control  
I/O  
Control  
[4]  
[4]  
I/O0L–I/O7/8L  
I/O0L–I/O7/8R  
14  
14  
Address  
Decode  
Address  
Decode  
True Dual-Ported  
RAM Array  
A0L–A13L  
A0R–A13R  
14  
14  
A0L–A13L  
CEL  
A0R–A13R  
CER  
Interrupt  
Semaphore  
Arbitration  
OEL  
OER  
R/WL  
SEML  
R/WR  
SEMR  
[5]  
[5]  
BUSYL  
BUSYR  
INTR  
UBR  
INTL  
UBL  
LBL  
M/S  
LBR  
Notes  
1. CY7C026A and CY7C026B are functionally identical.  
2. See page 6 for Load Conditions.  
3. I/O –I/O for x16 devices; I/O –I/O for x18 devices.  
8
15  
9
17  
4. I/O –I/O for x16 devices; I/O –I/O for x18 devices.  
0
7
0
8
5. BUSY is an output in master mode and an input in slave mode.  
Cypress Semiconductor Corporation  
Document #: 38-06046 Rev. *D  
•
198 Champion Court  
•
San Jose  
,
CA 95134-1709  
•
408-943-2600  
Revised December 10, 2008  
[+] Feedback  
 
 
 
 
 
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CY7C026A-20AXCT 替代型号

型号 品牌 替代类型 描述 数据表
CY7C026A-20AXC CYPRESS

类似代替

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