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CY74FCT16500CTPVCT PDF预览

CY74FCT16500CTPVCT

更新时间： 2024-01-12 09:54:56
品牌 Logo 应用领域
德州仪器 - TI 总线驱动器总线收发器逻辑集成电路光电二极管输出元件
页数 文件大小 规格书
6页 66K
描述
18-Bit Registered Transceivers

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CY74FCT16500CTPVCT 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SSOP
包装说明：SSOP,针数：56
Reach Compliance Code：unknown风险等级：5.68
Is Samacsys：N系列：FCT
JESD-30 代码：R-PDSO-G56JESD-609代码：e4
长度：18.415 mm逻辑集成电路类型：REGISTERED BUS TRANSCEIVER
湿度敏感等级：1位数：18
功能数量：1端口数量：2
端子数量：56最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH峰值回流温度（摄氏度）：260
传播延迟（tpd）：5.3 ns座面最大高度：2.79 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：NICKEL PALLADIUM GOLD端子形式：GULL WING
端子节距：0.635 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.49 mm
Base Number Matches：1

CY74FCT16500CTPVCT 数据手册

 浏览型号CY74FCT16500CTPVCT的Datasheet PDF文件第2页浏览型号CY74FCT16500CTPVCT的Datasheet PDF文件第3页浏览型号CY74FCT16500CTPVCT的Datasheet PDF文件第4页浏览型号CY74FCT16500CTPVCT的Datasheet PDF文件第5页浏览型号CY74FCT16500CTPVCT的Datasheet PDF文件第6页 
Data sheet acquired from Cypress Semiconductor Corporation.  
Data sheet modified to remove devices not offered.  
CY74FCT16500T  
CY74FCT162500T  
SCCS056 - August 1994 - Revised March 2000  
18-Bit Registered Transceivers  
Features  
Functional Description  
• FCT-C speed at 4.6 ns  
• Power-off disable outputs permits live insertion  
• Edge-rate control circuitry for significantly improved  
noise characteristics  
• Typical output skew < 250 ps  
• ESD > 2000V  
• TSSOP (19.6-mil pitch) and SSOP (25-mil pitch)  
packages  
• Industrial temperature range of −40˚C to +85˚C  
• VCC = 5V ± 10%  
These 18-bit universal bus transceivers can be operated in  
transparent, latched, or clock modes by combining D-type  
latches and D-type flip-flops. Data flow in each direction is  
controlled by output-enable (OEAB and OEBA), latch enable  
(LEAB and LEBA), and clock inputs (CLKAB and CLKBA)  
inputs. For A-to-B data flow, the device operates in transparent  
mode when LEAB is HIGH. When LEAB is LOW, the A data is  
latched if CLKAB is held at a HIGH or LOW logic level. If LEAB  
is LOW, the A bus data is stored in the latch/flip-flop on the  
HIGH-to-LOW transition of CLKAB. OEAB performs the output  
enable function on the B port. Data flow from B-to-A is similar  
to that of A-to-B and is controlled by OEBA, LEBA, and  
CLKBA. The output buffers are designed with power-off  
disable feature that allows live insertion of boards.  
CY74FCT16500T Features:  
• 64 mA sink current, 32 mA source current  
• Typical VOLP (ground bounce) <1.0V at VCC = 5V,  
TA = 25˚C  
The CY74FCT16500T is ideally suited for driving  
high-capacitance loads and low-impedance backplanes.  
The CY74FCT162500T has 24-mA balanced output drivers  
with current limiting resistors in the outputs. This reduces the  
need for external terminating resistors and provides for  
minimal undershoot and reduced ground bounce. The  
CY74FCT162500T is ideal for driving transmission lines.  
CY74FCT162500T Features:  
• Balanced 24 mA output drivers  
• Reduced system switching noise  
• Typical VOLP (ground bounce) <0.6V at VCC = 5V,  
TA= 25˚C  
Logic Block Diagram  
Pin Configuration  
SSOP/TSSOP  
Top View  
GND  
1
2
3
4
56  
55  
54  
OEAB  
LEAB  
CLKAB  
B
1
A
1
OEAB  
GND  
GND  
53  
52  
51  
50  
B
2
A
2
5
6
CLKBA  
B
V
A
3
3
V
CC  
CC  
LEBA  
OEBA  
7
B
A
4
4
5
6
49  
48  
47  
46  
8
A
A
B
B
5
6
9
CLKAB  
LEAB  
10  
11  
GND  
GND  
A
7
B
7
45  
44  
43  
12  
13  
A
A
B
B
B
8
9
8
C
D
C
D
14  
15  
16  
17  
18  
9
B
1
A
10  
42  
41  
A
1
10  
A
A
B
11  
B
12  
11  
12  
40  
39  
38  
GND  
GND  
C
D
C
D
A
A
A
B
13  
14  
15  
19  
20  
21  
22  
23  
13  
14  
15  
B
37  
36  
35  
34  
B
V
V
CC  
CC  
B
16  
A
16  
17  
A
33  
32  
31  
30  
29  
B
17  
24  
25  
TO 17 OTHER CHANNELS  
GND  
GND  
FCT16500-1  
A
B
18  
26  
27  
28  
18  
OEBA  
LEBA  
CLKBA  
GND  
FCT16500-2  
Copyright © 2000, Texas Instruments Incorporated  
123456

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