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CY36502H

更新时间： 2024-09-16 20:09:43
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
12页 148K
描述
PLL Based Clock Driver, 1 True Output(s), 1 Inverted Output(s), CMOS, PDSO24, 0.150 INCH, SSOP-24

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CY36502H 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：SSOP
包装说明：SSOP,针数：24
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.92输入调节：STANDARD
JESD-30 代码：R-PDSO-G24JESD-609代码：e0
长度：8.65 mm逻辑集成电路类型：PLL BASED CLOCK DRIVER
湿度敏感等级：1功能数量：1
反相输出次数：1端子数量：24
实输出次数：1最高工作温度：70 °C
最低工作温度：输出特性：3-STATE
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：220认证状态：Not Qualified
座面最大高度：1.75 mm最大供电电压 (Vsup)：3.465 V
最小供电电压 (Vsup)：3.135 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：TIN LEAD
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：3.9116 mmBase Number Matches：1

CY36502H 数据手册

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PRELIMINARY  
CY26501/CY26502  
533-MHz Direct Rambus™ Clock Generator  
Features  
Overview  
• Differential clock source for Direct Rambus™ memory  
subsystem for up to 1066-MHz data transfer rate  
• Providesynchronization flexibility:the Rambus®Chan-  
nel can optionally be synchronous to an external sys-  
tem or processor clock  
The Cypress CY26501 and CY26502 provide the differential  
clock signals for a Direct Rambus memory subsystem. It in-  
cludes signals to synchronize the Direct Rambus Channel  
clock to an external system clock but can also be used in sys-  
tems that do not require synchronization of the Rambus clock.  
• Power managed output allows Rambus Channel clock  
to be turned off to minimize power consumption for  
mobile applications  
Key Specifications  
Supply Voltage:...................................... V = 3.3V±0.165V  
DD  
• Cycle to Cycle Jitter below 60 ps  
Operating Temperature: ................................... 0°C to +70°C  
Input Threshold: .................................................. 1.5V typical  
• Low-power CMOS design packaged in a 24-pin, 150-mil  
SSOP package  
Maximum Input Voltage:.........................................V +0.5V  
DD  
Maximum Input Frequency: ..................................... 100 MHz  
Output Duty Cycle: .................................. 40/60% worst case  
Output Type: ............................Rambus signaling level (RSL)  
Block Diagram  
Pin Configuration  
REFCLK  
VDDIR  
REFCLK  
VDD  
1
2
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
14  
13  
S0  
PLL  
MULT0:1  
S1  
3
VDD  
GND  
CLK  
NC  
GND  
4
GND  
5
PCLKM  
SYNCLKN  
GND  
6
7
CLKB  
GND  
VDD  
MULT0  
MULT1  
GND  
CLK  
Output  
Logic  
Phase  
Alignment  
PCLKM  
8
CLKB  
VDD  
9
SYNCLKN  
VDDIPD  
STOPB  
PWRDNB  
10  
11  
12  
Test  
Logic  
S0:1  
STOPB  
Direct Rambus is a trademark and Rambus is a registered trademark of Rambus Inc.  
Intel is a registered trademark of Intel Corporation.  
Cypress Semiconductor Corporation  
•
3901 North First Street  
•
San Jose  
•
CA 95134  
•
408-943-2600  
November 17, 2000, Rev. *A  
1234567...12

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