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CY2LL843SI

更新时间： 2024-11-20 03:12:59

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赛普拉斯 - CYPRESS		复用器中继器驱动
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13页	262K
描述
High-drive Two-Channel LVDS Repeater/Mux

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CY2LL843SI 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	SOP, SOP16,.25
针数：	16	Reach Compliance Code：	not_compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.92	差分输出：	YES
驱动器位数：	2	输入特性：	DIFFERENTIAL SCHMITT TRIGGER
接口集成电路类型：	LINE TRANSCEIVER	接口标准：	EIA-644; TIA-644
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e0
长度：	9.8933 mm	功能数量：	2
端子数量：	16	最高工作温度：	85 °C
最低工作温度：	-40 °C	最小输出摆幅：	0.247 V
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP16,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	3.3 V	认证状态：	Not Qualified
最大接收延迟：	6 ns	接收器位数：	2
座面最大高度：	1.7272 mm	子类别：	Line Driver or Receivers
最大压摆率：	35 mA	最大供电电压：	3.6 V
最小供电电压：	3 V	标称供电电压：	3.3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	最大传输延迟：	6 ns
宽度：	3.899 mm	Base Number Matches：	1

CY2LL843SI 数据手册

ComLink™ Series

CY2LL843

High-drive Two-Channel LVDS Repeater/Mux

achieve signaling rates of 700Mbs. The receiver outputs can

be switched to either or both drivers through the multiplexer

Features

• ANSI TIA/EIA-644-1995-compliant

control signals S0/S1. This provides flexibility in application for

either a splitter or router configuration with a single device.

• Designed for data rates to > 700 Mbs = (350 MHz)

• Single 2 × 2 with high-drive output drivers

The Cypress CY2LL843 are configured as

two-channel repeater/Mux.

a single

• Low -voltage differential signaling with output voltages

of ± 350 mV into 50-ohm load version (Bus LVDS)

The LVDS standard provides a minimum differential output

voltage of 247 mV into a 50-ohm load and receipt of as little as

100 mV signals with up to 1V of DC offset between transmitter

and receiver. The Cypress CY2LL843 doubles the output drive

current to achieve BusLVDS signaling levels with a faster

rise/fall times into 50-ohm load.

• Single 3.3V supply

• Accepts ± 350-mV differential inputs

• Output Drivers are high-impedance when disabled or

when V_DD≤1.5V

• 16-pin SOIC/TSSOP packages

• Industrial version available

A doubly terminated BusLVDS line enables multipoint config-

urations.

Description

Designed for both point to point based-band multi-point data

transmission over controlled impedance lines.

The Cypress CY2LL843 are differential line drivers and

receivers that utilize Low Voltage Signaling or LVDS, to

Block Diagram

Pin Configuration

VDD

1DE

VDD

GND

2DE

S0 S1

1DE

2DE

GND

16 pin SOIC/TSSOP

Cypress Semiconductor Corporation

•

3901 North First Street

•

San Jose

•

CA 95134

•

408-943-2600

Document #: 38-07066 Rev. OBS

Revised December 02, 2004

12 3 4 5 6 7...13

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