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CY28344PVC PDF预览

CY28344PVC

更新时间： 2024-02-26 22:45:03
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 晶体时钟发生器微控制器和处理器外围集成电路光电二极管
页数 文件大小 规格书
22页 199K
描述
FTG for Intel Pentium 4 CPU and Chipsets

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CY28344PVC 技术参数

生命周期：Obsolete零件包装代码：SSOP
包装说明：SSOP,针数：48
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.52
JESD-30 代码：R-PDSO-G48JESD-609代码：e0
长度：15.875 mm湿度敏感等级：1
端子数量：48最高工作温度：70 °C
最低工作温度：最大输出时钟频率：200 MHz
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：220主时钟/晶体标称频率：14.318 MHz
认证状态：Not Qualified座面最大高度：2.794 mm
最大供电电压：3.465 V最小供电电压：3.135 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：TIN LEAD端子形式：GULL WING
端子节距：0.635 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.5057 mm
uPs/uCs/外围集成电路类型：CLOCK GENERATOR, PROCESSOR SPECIFICBase Number Matches：1

CY28344PVC 数据手册

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CY28344  
PRELIMINARY  
FTG for Intel Pentium 4 CPU and Chipsets  
• Capable of generating system RESET after a Watchdog  
timer time-out occurs or a change in output frequency  
via SMBus interface  
• Support SMBus byte Read/Write and block Read/Write  
operations to simplify system BIOS development  
• Vendor ID and Revision ID support  
Features  
• Compatible to Intel® CK-Titan and CK-408 Clock  
Synthesizer/Driver Specifications  
• System frequency synthesizer for Intel Brookdale (845)  
and Brookdale G Pentium® 4 Chipsets  
• Programmable clock output frequency with less than  
1MHz increment  
• Programmable drive strength support  
• Programmable output skew support  
• Power management control inputs  
• Integrated fail-safe Watchdog timer for system  
recovery  
• Available in 48-pin SSOP  
• Automatically switch to HW-selected or  
SW-programmed clock frequency when Watchdog  
timer time-out  
CPU  
×3  
3V66  
×4  
PCI  
×9  
REF  
×1  
48M  
×2  
Pin Configuration[1]  
Block Diagram  
VDD_REF  
REF_2X  
VDD_REF  
X1  
1
2
3
4
5
6
7
8
48  
47  
46  
45  
44  
43  
42  
41  
40  
39  
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
28  
27  
26  
25  
REF_2X/FS2^  
CPU0  
CPU0#  
VDD_CPU  
CPU1  
CPU1#  
GND_CPU  
VDD_CPU  
CPU2  
CPU2#  
MULTSEL0  
IREF  
GND_CPU  
48MHz/FS3^  
24_48MHz  
VDD_48MHz  
GND_48MHz  
3V66_0/VCH_CLK/FS4^  
VDD_3V66  
GND_3V66  
SCLK  
SDATA  
VTTPWRGD/PD#*  
GND_CORE  
X1  
X2  
XTAL  
OSC  
PLL Ref Freq  
X2  
Divider  
GND_REF  
^FS0/PCI_F0  
^FS1/PCI_F1  
VDD_PCI  
GND_PCI  
PCI0  
VDD_CPU  
CPU0:2, CPU0:2#,  
PLL 1  
Network  
FS0:4  
MULTSEL0  
9
PCI1  
PCI2  
PCI3  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
VDD_3V66  
3V66_1:3  
VDD_PCI  
GND_PCI  
PCI4  
VDD_3V66  
3V66_0/VCH_CLK  
VTTPWRGD/PD#  
PCI5  
PCI6  
VDD_PCI  
PCI_F0:1  
VDD_3V66  
GND_3V66  
3V66_1  
3V66_2  
3V66_3  
RST#  
PCI0:6  
VDD_48MHz  
48MHz  
PLL2  
VDD_CORE  
24_48MHz  
RST#  
SSOP-48  
2
SDATA  
SCLK  
SMBus  
Logic  
Note:  
1. Signals marked with “*” and “^,” respectively, have internal pull-up and  
pull-down resistors.  
Cypress Semiconductor Corporation  
•
3901 North First Street  
•
San Jose  
•
CA 95134  
•
408-943-2600  
Document #: 38-07113, Rev. *A  
Revised December 26, 2002  
1234567...22

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