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CY28341OC-2

更新时间： 2024-11-18 20:20:23
品牌 Logo 应用领域
芯科 - SILICON 时钟光电二极管外围集成电路晶体
页数 文件大小 规格书
18页 224K
描述
Processor Specific Clock Generator, 200MHz, CMOS, PDSO56, SSOP-56

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CY28341OC-2 技术参数

生命周期：Obsolete零件包装代码：SSOP
包装说明：SSOP,针数：56
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.22
Is Samacsys：NJESD-30 代码：R-PDSO-G56
JESD-609代码：e0长度：18.415 mm
湿度敏感等级：1端子数量：56
最高工作温度：70 °C最低工作温度：
最大输出时钟频率：200 MHz封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH峰值回流温度（摄氏度）：220
主时钟/晶体标称频率：14.31818 MHz认证状态：Not Qualified
座面最大高度：2.794 mm最大供电电压：3.465 V
最小供电电压：3.135 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：TIN LEAD
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.5 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：1

CY28341OC-2 数据手册

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CY28341-2  
Universal Clock Chip for VIA™P4M/KT/KM400 DDR Systems  
Features  
Table 1. Frequency Selection Table  
FS(3:0)  
0000  
0001  
0010  
0011  
0100  
0101  
0110  
0111  
1000  
1001  
1010  
1011  
1100  
1101  
1110  
1111  
CPU  
AGP  
66.80  
66.80  
60.00  
66.67  
72.00  
70.00  
64.00  
70.00  
77.00  
73.33  
60.00  
66.6  
PCI  
• Supports VIA¥ P4M/KM/KT/266/333/400 chipsets  
• Supports Pentium® 4, Athlon™ processors  
• Supports two DDR DIMMS  
66.80  
33.40  
33.40  
30.00  
33.33  
36.00  
35.00  
32.00  
35.00  
38.50  
36.67  
30.00  
33.3  
100.00  
120.00  
133.33  
72.00  
• Supports three SDRAM DIMMS at 100 MHz  
• Provides:  
105.00  
160.00  
140.00  
77.00  
— two different programmable CPU clock pairs  
— six differential SDRAM DDR pairs  
— three low-skew/-jitter AGP clocks  
— seven low-skew/-jitter PCI clocks  
— one 48M output for USB  
110.00  
180.00  
166.6  
— one programmable 24M or 48M for SIO  
• Dial-a-Frequency£ and Dial-a-dB¥ features  
90.00  
60.00  
66.67  
66.67  
66.67  
30.00  
33.33  
33.33  
33.33  
100.00  
200.00  
133.33  
• SpreadSpectrumforbestelectromagneticinterference  
(EMI) reduction  
• Watchdog feature for system recovery  
• SMBus-compatible for programmability  
• 56-pin SSOP and TSSOP packages  
Pin Configuration[1]  
Block Diagram  
VDDR  
XIN  
XOUT  
1
2
3
4
5
6
7
8
56  
55  
54  
53  
52  
51  
50  
49  
48  
47  
46  
45  
44  
43  
42  
41  
40  
39  
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
*FS0/REF0  
VSSR  
VTTPWRGD#/REF1  
VDDR  
VSSC  
CPUT/CPUOD_T  
CPUC/CPUOD_C  
VDDC  
REF(0:1)  
VDDI  
XTAL  
FS2  
REF0  
XIN  
XOUT  
VDDAGP  
AGP0  
*SELP4_K7/AGP1  
AGP2  
VSSAGP  
**FS1/PCI_F  
**SELSDR_DDR/PCI1  
CPUCS_T/C  
FS0  
VDDC  
SELP4_K7#  
VDDI  
CPU(0:1)/CPU0D_T/C  
PLL1  
CPUCS_C  
CPUCS_T  
VSSI  
FBOUT  
BUF_IN  
DDRT0/SDRAM0  
DDRC0/SDRAM1  
DDRT1/SDRAM2  
DDRC1/SDRAM3  
VDDD  
9
VDDPCI  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
25  
26  
27  
28  
PCI(3:6)  
FS3 FS1  
*MULTSEL/PCI2  
VSSPCI  
PCI3  
PCI_F  
MULTSEL  
PCI2  
PD#  
PCI4  
VDDPCI  
PCI5  
PCI1  
VDDAGP  
AGP(0:2)  
PCI6  
VSSD  
VSS48M  
**FS3/48M  
**FS2/24_48M  
VDD48M  
VDD  
VSS  
IREF  
*PD#/SRESET#  
SCLK  
DDRT2/SDRAM4  
DDRC2/SDRAM5  
DDRT3/SDRAM6  
DDRC3/SDRAM7  
VDDD  
VDD48M  
48M  
SDATA  
SCLK  
SMBus  
PLL2  
/ 2  
WDEN  
VSSD  
24_48M  
DDRT4/SDRAM8  
DDRC4/SDRAM9  
DDRT5/SDRAM10  
DDRC5/SDRAM11  
SRESET#  
VDDD  
WD  
SDATA  
SELSDR_DDR  
FBOUT  
S2D  
56 pin SSOP  
DDRT(0:5)/SDRAM(0,2,4,6,8,10)  
DDRC(0:5)/SDRAM(1,3,5,7,9,11)  
Buf_IN  
CONVERT  
Note:  
1. Pins marked with [*] have internal pull-up resistors. Pins marked with [**] have internal pull-down resistors.  
Rev 1.0, November 21, 2006  
Page 1 of 18  
2200 Laurelwood Road, Santa Clara, CA 95054  
Tel:(408) 855-0555 Fax:(408) 855-0550  
www.SpectraLinear.com  
1234567...18

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型号 品牌 获取价格 描述 数据表
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