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Datasheet > 电信电路 > 数字传输接口> CS61584A-IL3
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CS61584A-IL3

更新时间： 2024-11-08 23:14:31
品牌 Logo 应用领域
凌云 - CIRRUS 数字传输接口电信集成电路电信电路PC
页数 文件大小 规格书
54页 1013K
描述
DUAL T1/E1 LINE INTERFACE

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CS61584A-IL3 技术参数

是否无铅：含铅是否Rohs认证：不符合
生命周期：Obsolete零件包装代码：LCC
包装说明：QCCJ, LDCC68,1.0SQ针数：68
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.83Is Samacsys：N
JESD-30 代码：S-PQCC-J68JESD-609代码：e0
长度：24.206 mm湿度敏感等级：3
功能数量：2端子数量：68
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC68,1.0SQ封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：225
电源：3.3 V认证状态：Not Qualified
座面最大高度：5.08 mm子类别：Digital Transmission Interfaces
标称供电电压：3.3 V表面贴装：YES
技术：CMOS电信集成电路类型：PCM TRANSCEIVER
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：24.206 mmBase Number Matches：1

CS61584A-IL3 数据手册

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CS61584A  
Dual T1/E1 Line Interface  
– AT&T Publication 62411  
– ETSI ETS 300 011, 300 233, CTR 12, TBR 13  
l TR-NET-00499  
Features  
l Dual T1/E1 Line Interface  
l 3.3 Volt and 5 Volt Versions  
l Crystal-less Jitter Attenuator Meets  
European CTR 12 and ETSI ETS 300 011  
Specifications  
l Matched Impedance Transmit Drivers  
l Transmitter Tri-state Capability  
l Common Transmit and  
Description  
The CS61584A is a dual line interface for T1/E1 appli-  
cations, designed for high-volume cards where low  
power and high density are required. The device is op-  
timized for flexible microprocessor control through a  
serial or parallel Host mode interface. Hardware mode  
operation is also available.  
ReceiveTransformers for all Modes  
Matched impedance drivers reduce power consumption  
and provide substantial transmitter return loss. The  
transmitter pulse shapes are customizable to allow non-  
standard line loads. Crystalless jitter attenuation com-  
plies with most stringent standards. Support of JTAG  
boundary scan enhances system testability and  
reliability.  
l Serial and Parallel Host Mode Operation  
l User-customizable Pulse Shapes  
l Supports JTAG Boundary Scan  
l Compliant with:  
– ITU-T Recommendations: G.703, G.704,  
G.706, G.732, G.775 and I.431  
ORDERING INFORMATION  
– American National Standards (ANSI): T1.102,  
T1.105, T1.403, T1.408, and T1.231  
See page 53.  
CS61584A-IQ3:3.3V, 64-pin TQFP, -40 to +85° C  
CS61584A-IL5:5.0V, 68-pin PLCC, -40 to +85° C  
CS61584A-IQ5:5.0V, 64-pin TQFP, -40 to +85° C  
– FCC Rules and Regulations: Part 68 and Part  
15  
Serial Port  
Parallel Port IPOL (DTACK) P/S  
CS  
CS  
INT  
INT  
SCLK  
RD(DS)  
SDO  
AD0  
SDI  
AD1  
SPOL  
AD2  
P/S  
IPOL  
AD3  
AD4  
AD5  
AD6  
AD7 ALE(AS) WR(R/W) BTS  
Hardware Mode  
CLKE ATTEN0 ATTEN1 RLOOP1 RLOOP2 LLOOP TAOS1 TAOS2 CON01 CON02 CON11 CON12 CON21 CON22 CON31 CON32  
CONTROL  
E
N
C
O
D
E
R
R
E
M
O
T
L
O
C
A
L
L
O
C
A
L
TTIP1  
TCLK1  
(TDATA1) TPOS1  
(AIS1) TNEG1  
RCLK1  
PULSE  
SHAPING  
CIRCUITRY  
TAOS  
DRIVER  
TRING1  
E
L
O
O
P
B
A
C
K
1
L
O
O
P
B
A
C
K
2
JITTER  
ATTENUATOR  
L
O
O
P
B
A
C
K
D
E
C
O
D
E
R
RTIP1  
LOS &  
AIS  
DETECT  
CLOCK &  
DATA  
RECOVERY  
(RDATA1) RPOS1  
(BPV1) RNEG1  
RECEIVER  
RRING1  
E
N
C
O
D
E
R
R
E
M
O
T
L
O
C
A
L
L
O
C
A
L
TTIP2  
TCLK2  
(TDATA2) TPOS2  
(AIS2) TNEG2  
PULSE  
SHAPING  
CIRCUITRY  
TAOS  
DRIVER  
TRING2  
E
L
O
O
P
B
A
C
K
1
L
O
O
P
B
A
C
K
2
JITTER  
ATTENUATOR  
L
O
O
P
B
A
C
K
D
E
C
O
D
E
R
RCLK2  
(RDATA2) RPOS2  
(BPV2) RNEG2  
RTIP2  
LOS &  
AIS  
DETECT  
CLOCK &  
DATA  
RECOVERY  
RECEIVER  
RRING2  
RESET  
MODE  
CONTROL  
JTAG  
CLOCK GENERATOR  
2
2
2
2
3
4
REFCLK XTALOUT 1XCLK  
TV+ TGND RV+ RGND DV+ DGND AV+ AGND BGREF PD1 PD2 LOS1 LOS2  
SAD4 SAD5 SAD6 SAD7  
Hardware Mode  
Parallel Port  
Serial Port  
ZTX1 ZTX2 LOS1 LOS2  
Copyright Cirrus Logic, Inc. 2005  
SEP ‘05  
http://www.cirrus.com  
(All Rights Reserved)  
DS261F1  
1234567...54

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