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CDC706PWRG4 PDF预览

CDC706PWRG4

更新时间： 2024-02-20 03:58:54
品牌 Logo 应用领域
德州仪器 - TI 晶体时钟发生器微控制器和处理器外围集成电路光电二极管信息通信管理
页数 文件大小 规格书
41页 1103K
描述
PROGRAMMABLE 3-PLL CLOCK SYNTHESIZER / MULTIPLIER / DIVIDER

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CDC706PWRG4 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Not Recommended零件包装代码：TSSOP
包装说明：TSSOP,针数：20
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.21
Is Samacsys：NJESD-30 代码：R-PDSO-G20
JESD-609代码：e4长度：6.5 mm
湿度敏感等级：1端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
最大输出时钟频率：54 MHz封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
主时钟/晶体标称频率：8 MHz认证状态：Not Qualified
座面最大高度：1.2 mm最大压摆率：115 mA
最大供电电压：3.6 V最小供电电压：3 V
标称供电电压：3.3 V表面贴装：YES
技术：BICMOS温度等级：INDUSTRIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：4.4 mm
uPs/uCs/外围集成电路类型：CLOCK GENERATOR, OTHERBase Number Matches：1

CDC706PWRG4 数据手册

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CDC706  
www.ti.com  
SCAS829A–SEPTEMBER 2006–REVISED MARCH 2007  
PROGRAMMABLE 3-PLL CLOCK SYNTHESIZER / MULTIPLIER / DIVIDER  
FEATURES  
•
•
Packaged in 20-Pin TSSOP  
•
High Performance 2:6 PLL Based Clock  
Synthesizer / Multiplier / Divider  
Factory Programmable for Customized Default  
Settings are Available. Contact TI Sales for  
More Details.  
•
•
User Programmable PLL Frequencies  
Easy In-Circuit Programming via SMBus Data  
Interface  
APPLICATIONS  
•
•
•
Wireless Base Stations  
Network Line Cards  
Datacom / Telecom  
•
•
Wide PLL Divider Ratio Allows 0-PPM Output  
Clock Error  
Clock Inputs Accept a Crystal or a  
Single-Ended LVCMOS or a Differential Input  
Signal  
TERMINAL ASSIGNMENT  
PW PACKAGE  
(TOP VIEW)  
•
•
•
•
•
•
Accepts Crystal Frequencies from 8 MHz up  
to 54 MHz  
Accepts LVCMOS or Differential Input  
Frequencies up to 200 MHz  
1
20  
19  
18  
17  
16  
15  
14  
13  
12  
11  
S0/CLK_SEL  
Y5  
2
S1  
VCC  
Y4  
3
VCCOUT2  
GND  
Y3  
Two Programmable Control Inputs [S0/S1] for  
User Defined Control Signals  
4
GND  
CLK_IN0  
CLK_IN1  
VCC  
TSSOP 20  
Pitch 0,65 mm  
6.6 x 6.6  
5
Six LVCMOS Outputs with Output  
Frequencies up to 300 MHz  
6
Y2  
7
VCCOUT1  
GND  
Y1  
LVCMOS Outputs can be Programmed for  
Complementary Signals  
8
GND  
9
SDATA  
SCLOCK  
10  
Y0  
Free Selectable Output Frequency via  
Programmable Output Switching Matrix [6x6]  
Including 7-Bit Post-Divider for Each Output  
•
•
•
PLL Loop Filter Components Integrated  
Low Period Jitter (Typical 60 ps)  
Features Spread Spectrum Clocking (SSC) for  
Lowering System EMI  
•
Programmable Output Slew-Rate Control  
(SRC) for Lowering System EMI  
•
•
•
3.3-V Device Power Supply  
Industrial Temperature Range –40°C to 85°C  
Development and Programming Kit for Easy  
PLL Design and Programming  
(TI Pro-Clock™)  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of Texas  
Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Pro-Clock is a trademark of Texas Instruments.  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of the Texas  
Instruments standard warranty. Production processing does not  
necessarily include testing of all parameters.  
Copyright © 2006–2007, Texas Instruments Incorporated  
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