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CDC351DBRG4 PDF预览

CDC351DBRG4

更新时间： 2024-11-13 12:33:07
品牌 Logo 应用领域
德州仪器 - TI 时钟驱动器逻辑集成电路光电二极管输出元件信息通信管理
页数 文件大小 规格书
13页 507K
描述
1-LINE TO 10-LINE CLOCK DRIVER WITH 3-STATE OUTPUTS

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CDC351DBRG4 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SSOP
包装说明：SSOP-24针数：24
Reach Compliance Code：compliantHTS代码：8542.39.00.01
Factory Lead Time：6 weeks风险等级：5.27
Is Samacsys：N系列：351
输入调节：STANDARDJESD-30 代码：R-PDSO-G24
JESD-609代码：e4长度：8.2 mm
负载电容（CL）：50 pF逻辑集成电路类型：LOW SKEW CLOCK DRIVER
最大I（ol）：0.032 A湿度敏感等级：1
功能数量：1反相输出次数：
端子数量：24实输出次数：10
最高工作温度：70 °C最低工作温度：
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装等效代码：SSOP24,.3
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
包装方法：TR峰值回流温度（摄氏度）：260
电源：3.3 V最大电源电流（ICC）：25 mA
Prop。Delay @ Nom-Sup：4.2 ns传播延迟（tpd）：4.2 ns
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.8 ns
座面最大高度：2 mm子类别：Clock Drivers
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：BICMOS温度等级：COMMERCIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：5.3 mm
最小 fmax：100 MHzBase Number Matches：1

CDC351DBRG4 数据手册

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CDC351. CDC351I  
1-LINE TO 10-LINE CLOCK DRIVER WITH 3-STATE OUTPUTS  
www.ti.com  
SCAS441D–FEBRUARY 1994–REVISED OCTOBER 2003  
FEATURES  
DB OR DW PACKAGE  
•
Low Output Skew, Low Pulse Skew for  
Clock-Distribution and Clock-Generation  
Applications  
(TOP VIEW)  
GND  
Y10  
VCC  
Y9  
OE  
A
GND  
Y1  
1
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
14  
13  
2
•
•
•
Operates at 3.3-V VCC  
3
VCC  
Y2  
GND  
Y3  
LVTTL-Compatible Inputs and Outputs  
Supports Mixed-Mode Signal Operation (5-V  
Input and Output Voltages With 3.3-V VCC  
4
5
)
6
7
P0  
Y4  
•
•
Distributes One Clock Input to Ten Outputs  
8
P1  
Y8  
VCC  
Y7  
GND  
GND  
Y5  
VCC  
Y6  
Distributed VCC and Ground Pins Reduce  
Switching Noise  
9
10  
11  
12  
•
•
High-Drive Outputs (–32-mA IOH, 32-mA IOL)  
State-of-the-Art EPIC-IIB™ BiCMOS Design  
Significantly Reduces Power Dissipation  
GND  
•
Package Options Include Plastic  
Small-Outline (DW) and Shrink Small-Outline  
(DB) Packages  
DESCRIPTION  
The CDC351 is a high-performance clock-driver circuit that distributes one input (A) to ten outputs (Y) with minimum  
skew for clock distribution. The output-enable (OE) input disables the outputs to a high-impedance state. The  
CDC351 operates at nominal 3.3-V VCC  
.
The propagation delays are adjusted at the factory using the P0 and P1 pins. The factory adjustments ensure that the  
part-to-part skew is minimized and is kept within a specified window. Pins P0 and P1 are not intended for customer  
use and should be connected to GND.  
FUNCTION TABLE  
INPUTS  
OUTPUTS  
Yn  
A
L
OE  
H
Z
Z
L
H
L
H
L
H
L
H
AVAILABLE OPTIONS  
(1)  
(1)  
TA  
Shrink Small-Outline Package (DB)  
CDC351DB  
Small-Outline Package (DW)  
CDC351DW  
0°C to 70°C  
– 40°C to 85°C  
CDC351IDB  
CDC351IDW  
(1)  
This package is available tape and reel. Order by adding an R to the orderable part number (e.g., CDC351DBR).  
EPIC-IIB is a trademark of Texas Instruments.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of Texas Instruments  
semiconductor products and disclaimers thereto appears at the end of this data sheet.  
PRODUCTION DATA information is current as of publication date.  
Copyright © 1994–2003, Texas Instruments Incorporated  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily in-  
cludetestingofallparameters.  
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CDC351DBRG4 替代型号

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