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Datasheet > 逻辑 > 栅极> CD54HC20F3A
CD54HC20F3A PDF预览

CD54HC20F3A

更新时间： 2024-11-11 22:39:51
品牌 Logo 应用领域
德州仪器 - TI 栅极触发器逻辑集成电路
页数 文件大小 规格书
9页 257K
描述
High-Speed CMOS Logic Dual 4-Input NAND Gate

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CD54HC20F3A 技术参数

生命周期：Active零件包装代码：DIP
包装说明：DIP, DIP14,.3针数：14
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.48
Is Samacsys：N系列：HC/UH
JESD-30 代码：R-GDIP-T14长度：19.56 mm
负载电容（CL）：50 pF逻辑集成电路类型：NAND GATE
最大I（ol）：0.004 A功能数量：2
输入次数：4端子数量：14
最高工作温度：125 °C最低工作温度：-55 °C
封装主体材料：CERAMIC, GLASS-SEALED封装代码：DIP
封装等效代码：DIP14,.3封装形状：RECTANGULAR
封装形式：IN-LINE包装方法：TUBE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：2/6 V
最大电源电流（ICC）：0.04 mAProp。Delay @ Nom-Sup：30 ns
传播延迟（tpd）：150 ns认证状态：Not Qualified
施密特触发器：NO筛选级别：38535Q/M;38534H;883B
座面最大高度：5.08 mm子类别：Gates
最大供电电压 (Vsup)：6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：4.5 V表面贴装：NO
技术：CMOS温度等级：MILITARY
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：6.67 mmBase Number Matches：1

CD54HC20F3A 数据手册

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CD54HC20, CD74HC20,  
CD54HCT20, CD74HCT20  
Data sheet acquired from Harris Semiconductor  
SCHS130C  
High-Speed CMOS Logic  
Dual 4-Input NAND Gate  
August 1997 - Revised September 2003  
Features  
Description  
• Buffered Inputs  
The ’HC20 and ’HCT20 logic gates utilize silicon gate CMOS  
technology to achieve operating speeds similar to LSTTL  
gates with the low power consumption of standard CMOS  
integrated circuits. All devices have the ability to drive 10  
LSTTL loads. The HCT logic family is functionally pin  
compatible with the standard LS logic family.  
• Typical Propagation Delay: 8ns at V  
o
= 5V,  
[ /Title  
(CD74H  
C20,  
CD74H  
CT20)  
/Subject  
(High  
Speed  
CMOS  
Logic  
Dual 4-  
Input  
CC  
C = 15pF, T = 25 C  
L
A
• Fanout (Over Temperature Range)  
- Standard Outputs. . . . . . . . . . . . . . . 10 LSTTL Loads  
- Bus Driver Outputs . . . . . . . . . . . . . 15 LSTTL Loads  
Ordering Information  
o
o
• Wide Operating Temperature Range . . . -55 C to 125 C  
• Balanced Propagation Delay and Transition Times  
TEMP. RANGE  
o
PART NUMBER  
CD54HC20F3A  
CD54HCT20F3A  
CD74HC20E  
( C)  
PACKAGE  
14 Ld CERDIP  
14 Ld CERDIP  
14 Ld PDIP  
14 Ld SOIC  
14 Ld SOIC  
14 Ld SOIC  
14 Ld PDIP  
14 Ld SOIC  
14 Ld SOIC  
14 Ld SOIC  
• Significant Power Reduction Compared to LSTTL  
Logic ICs  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
• HC Types  
- 2V to 6V Operation  
- High Noise Immunity: N = 30%, N = 30% of V  
IL IH CC  
CD74HC20M  
at V  
= 5V  
CC  
CD74HC20MT  
CD74HC20M96  
CD74HCT20E  
CD74HCT20M  
CD74HCT20MT  
CD74HCT20M96  
• HCT Types  
- 4.5V to 5.5V Operation  
- Direct LSTTL Input Logic Compatibility,  
V = 0.8V (Max), V = 2V (Min)  
IL IH  
- CMOS Input Compatibility, I ≤ 1µA at V , V  
OL OH  
l
NOTE: When ordering, use the entire part number. The suffix 96  
denotes tape and reel. The suffix T denotes a small-quantity reel  
of 250.  
Pinout  
CD54HC20, CD54HCT20  
(CERDIP)  
CD74HC20, CD74HCT20  
(PDIP, SOIC)  
TOP VIEW  
1A  
1B  
1
2
3
4
5
6
7
14 V  
CC  
13 2D  
12 2C  
11 NC  
10 2B  
NC  
1C  
1D  
1Y  
9
8
2A  
2Y  
GND  
CAUTION: These devices are sensitive to electrostatic discharge. Users should follow proper IC Handling Procedures.  
Copyright © 2003, Texas Instruments Incorporated  
1
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CD54HC20F3A 替代型号

型号 品牌 替代类型 描述 数据表
CD74HC20EE4 TI

完全替代

 暂无描述
CD74HC20E TI

完全替代

 High Speed CMOS Logic Dual 4-Input NAND Gate
SN74HC20N TI

类似代替

 DUAL 4-INPUT POSITIVE-NAND GATES

与CD54HC20F3A相关器件

型号 品牌 获取价格 描述 数据表
CD54HC20H RENESAS

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 		CD54HC20H
CD54HC20H/3A RENESAS

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 		HC/UH SERIES, DUAL 4-INPUT NAND GATE, UUC14
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