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Datasheet > 逻辑 > 触发器/锁存器> CD54AC112F3A
CD54AC112F3A PDF预览

CD54AC112F3A

更新时间： 2024-09-14 22:34:31
品牌 Logo 应用领域
德州仪器 - TI 触发器锁存器逻辑集成电路
页数 文件大小 规格书
10页 330K
描述
DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WITH CLEAR AND PRESET

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CD54AC112F3A 技术参数

生命周期：Active零件包装代码：DIP
包装说明：DIP, DIP16,.3针数：16
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：1 week
风险等级：5.44Is Samacsys：N
系列：ACJESD-30 代码：R-GDIP-T16
长度：19.94 mm负载电容（CL）：50 pF
逻辑集成电路类型：J-K FLIP-FLOP最大频率@ Nom-Sup：71000000 Hz
最大I（ol）：0.012 A位数：2
功能数量：2端子数量：16
最高工作温度：125 °C最低工作温度：-55 °C
输出极性：COMPLEMENTARY封装主体材料：CERAMIC, GLASS-SEALED
封装代码：DIP封装等效代码：DIP16,.3
封装形状：RECTANGULAR封装形式：IN-LINE
包装方法：TUBE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：3.3/5 V最大电源电流（ICC）：0.08 mA
Prop。Delay @ Nom-Sup：14.4 ns传播延迟（tpd）：129 ns
认证状态：Not Qualified筛选级别：38535Q/M;38534H;883B
座面最大高度：5.08 mm子类别：FF/Latch
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：1.5 V
标称供电电压 (Vsup)：3.3 V表面贴装：NO
技术：CMOS温度等级：MILITARY
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：NEGATIVE EDGE宽度：7.62 mm
最小 fmax：100 MHzBase Number Matches：1

CD54AC112F3A 数据手册

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CD54AC112, CD74AC112  
DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS  
WITH CLEAR AND PRESET  
SCHS325 – JANUARY 2003  
CD54AC112 . . . F PACKAGE  
CD74AC112 . . . E OR M PACKAGE  
(TOP VIEW)  
AC Types Feature 1.5-V to 5.5-V Operation  
and Balanced Noise Immunity at 30% of the  
Supply Voltage  
Speed of Bipolar F, AS, and S, With  
Significantly Reduced Power Consumption  
1CLK  
1K  
V
CC  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
1CLR  
2CLR  
2CLK  
2K  
1J  
Balanced Propagation Delays  
1PRE  
1Q  
±24-mA Output Drive Current  
– Fanout to 15 F Devices  
1Q  
11 2J  
SCR-Latchup-Resistant CMOS Process and  
Circuit Design  
10  
9
2Q  
2PRE  
2Q  
GND  
Exceeds 2-kV ESD Protection Per  
MIL-STD-883, Method 3015  
description/ordering information  
The ’AC112 devices contain two independent J-K negative-edge-triggered flip-flops. A low level at the preset  
(PRE) or clear (CLR) inputs sets or resets the outputs, regardless of the levels of the other inputs. When PRE  
and CLR are inactive (high), data at the J and K inputs meeting the setup-time requirements is transferred to  
the outputs on the negative-going edge of the clock pulse (CLK). Clock triggering occurs at a voltage level and  
is not directly related to the fall time of the clock pulse. Following the hold-time interval, data at the J and K inputs  
may be changed without affecting the levels at the outputs. These versatile flip-flops can perform as toggle  
flip-flops by tying J and K high.  
ORDERING INFORMATION  
ORDERABLE  
PART NUMBER  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
PDIP – E  
SOIC – M  
CDIP – F  
Tube  
Tube  
CD74AC112E  
CD74AC112M  
CD74AC112E  
–55°C to 125°C  
AC112M  
Tape and reel CD74AC112M96  
Tube CD54AC112F3A  
CD54AC112F3A  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines  
are available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2003, Texas Instruments Incorporated  
On products compliant to MIL-PRF-38535, all parameters are tested  
unless otherwise noted. On all other products, production  
processing does not necessarily include testing of all parameters.  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...10

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CD54AC112F3A 替代型号

型号 品牌 替代类型 描述 数据表
CD74AC112M96 TI

完全替代

 DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WITH CLEAR AND PRESET
CD74AC112M TI

完全替代

 DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WITH CLEAR AND PRESET
SN74HC174DR TI

功能相似

 Wide Operating Voltage Range of 2 V to 6 V, Outputs Can Drive Up To 10 LSTTL Loads

与CD54AC112F3A相关器件

型号 品牌 获取价格 描述 数据表
CD54AC112H ETC

获取价格

 		Logic IC
CD54AC112HX GE

获取价格

 		J-K Flip-Flop, AC Series, 2-Func, Negative Edge Triggered, 2-Bit, Complementary Output, CM
CD54AC112M ETC

获取价格

 		Logic IC
CD54AC113A INTERSIL

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 		Dual “J-K” Flip-Flop with Set and Reset
CD54AC138 TI

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CD54AC138 INTERSIL

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