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CD4099BCN PDF预览

CD4099BCN

更新时间： 2024-09-15 22:54:19
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 锁存器
页数 文件大小 规格书
6页 56K
描述
8-Bit Addressable Latch

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CD4099BCN 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP, DIP16,.3
针数：16Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.03
其他特性：1:8 DMUX FOLLOWED BY LATCH; RESET ACTIVE ONLY WHEN LATCH ENABLE IS HIGH系列：4000/14000/40000
JESD-30 代码：R-PDIP-T16长度：19.305 mm
负载电容（CL）：50 pF逻辑集成电路类型：D LATCH
位数：1功能数量：1
端子数量：16最高工作温度：125 °C
最低工作温度：-55 °C输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP16,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：3/15 VProp。Delay @ Nom-Sup：400 ns
传播延迟（tpd）：400 ns认证状态：Not Qualified
座面最大高度：5.08 mm子类别：FF/Latches
最大供电电压 (Vsup)：15 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：CMOS温度等级：MILITARY
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：LOW LEVEL宽度：7.62 mm
Base Number Matches：1

CD4099BCN 数据手册

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October 1987  
Revised January 1999  
CD4099BC  
8-Bit Addressable Latch  
address. Therefore, this should only be done while in the  
memory mode (E = HIGH, CL = LOW).  
General Description  
The CD4099BC is an 8-bit addressable latch with three  
address inputs (A0–A2), an active low enable input (E),  
active high clear input (CL), a data input (D), and eight out-  
puts (Q0–Q7).  
Features  
■ Wide supply voltage range: 3.0V to 15V  
■ High noise immunity: 0.45 VDD (typ.)  
Data is entered into a particular bit in the latch when that bit  
is addressed by the address inputs and the enable (E) is  
LOW. Data entry is inhibited when enable (E) is HIGH.  
■ Low power TTL: fan out of 2 driving 74L  
compatibility: or 1 driving 74LS  
■ Serial to parallel capability  
When clear (CL) and enable (E) are HIGH, all outputs are  
LOW. When clear (CL) is HIGH and enable (E) is LOW, the  
channel demultiplexing occurs. The bit that is addressed  
has an active output which follows the data input while all  
unaddressed bits are held LOW. When operating in the  
addressable latch mode (E = CL = LOW), changing more  
than one bit of the address could impose a transient wrong  
■ Storage register capability  
■ Random (addressable) data entry  
■ Active high demultiplexing capability  
■ Common active high clear  
Ordering Code:  
Order Number Package Number  
Package Description  
CD4099BCN  
N16E  
16-Lead Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300” Wide  
Connection Diagram  
Pin Assignments for DIP  
Top View  
Truth Table  
Mode Selection  
E
CL  
Addressed  
Unaddressed  
Latch  
Mode  
Latch  
L
H
L
L
L
Follows Data  
Holds Previous Data Addressable Latch  
Holds Previous Data Holds Previous Data Memory  
H
H
Follows Data  
Reset to “0”  
Reset to “0”  
Reset to “0”  
Demultiplexer  
Clear  
H
© 1999 Fairchild Semiconductor Corporation  
DS005984.prf  
www.fairchildsemi.com  
123456

中文翻译

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CD4099BCN 替代型号

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