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CAT33C804AC PDF预览

CAT33C804AC

更新时间： 2024-01-17 11:05:20
品牌 Logo 应用领域
CATALYST 可编程只读存储器
页数 文件大小 规格书
14页 93K
描述
Memory IC

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CAT33C804AC 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：DIP
包装说明：DIP, DIP8,.3针数：8
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.32.00.51风险等级：5.92
Is Samacsys：N其他特性：SECURE ACCESS
备用内存宽度：16最大时钟频率 (fCLK)：3.57955 MHz
数据保留时间-最小值：100耐久性：100000 Write/Erase Cycles
JESD-30 代码：R-PDIP-T8JESD-609代码：e0
长度：9.27 mm内存密度：4096 bit
内存集成电路类型：EEPROM内存宽度：8
功能数量：1端子数量：8
字数：512 words字数代码：512
工作模式：SYNCHRONOUS最高工作温度：85 °C
最低工作温度：-40 °C组织：512X8
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP8,.3封装形状：RECTANGULAR
封装形式：IN-LINE并行/串行：SERIAL
峰值回流温度（摄氏度）：NOT SPECIFIED电源：3 V
认证状态：Not Qualified座面最大高度：4.57 mm
串行总线类型：3-WIRE最大待机电流：0.00025 A
子类别：EEPROMs最大压摆率：0.003 mA
最大供电电压 (Vsup)：3.3 V最小供电电压 (Vsup)：2.7 V
标称供电电压 (Vsup)：3 V表面贴装：NO
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.62 mm
最长写入周期时间 (tWC)：12 ms写保护：SOFTWARE
Base Number Matches：1

CAT33C804AC 数据手册

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Preliminary  
CAT33C804A  
4K-Bit Secure Access Serial E2PROM  
FEATURES  
■ Single 3V Supply  
■ 100,000 Program/Erase Cycles  
■ Password READ/WRITE Protection: 1 to 8 Bytes  
■ Memory Pointer WRITE Protection  
■ Sequential READ Operation  
■ I/O Speed: 9600 Baud  
–Clock Frequency: 4.9152 MHz Xtal  
■ Low Power Consumption:  
–Active: 3 mA  
■ 256 x 16 or 512 x 8 Selectable Serial Memory  
■ UART Compatible Asynchronous Protocol  
–Standby: 250 µA  
■ 100 Year Data Retention  
■ Commercial, Industrial and Automotive  
Temperature Ranges  
DESCRIPTION  
The CAT33C804A is a 4K-bit Serial E2PROM that safe-  
guards stored data from unauthorized access by use of  
a user selectable (1 to 8 byte) access code and a  
movablememorypointer. Twooperatingmodesprovide  
unprotected and password-protected operation allow-  
ing the user to configure the device as anything from a  
ROM to a fully protected no-access memory. The  
CAT33C804A uses a UART compatible asynchronous  
protocol and has a Sequential Read feature where data  
can be sequentially clocked out of the memory array.  
The device is available in 8-pin DIP or 16-pin SOIC  
packages.  
PIN CONFIGURATION  
BLOCK DIAGRAM  
DIP Package (P)  
SOIC Package (J)  
V
1
2
3
4
8
7
6
5
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
CC  
CS  
CLK  
DI  
V
NC  
NC  
CS  
CLK  
DI  
NC  
NC  
V
CC  
GND  
PE  
64-BIT ACCESS CODE  
ERR  
GND  
&
CC  
CONTROL BLOCK  
DO  
PE  
DO  
ERR  
GND  
NC  
SERIAL  
CLK  
DO  
NC  
NC  
COMMUNI-  
CATION  
BLOCK  
PE  
CS  
DI  
4K-BIT EEPROM  
ARRAY  
NC  
PIN FUNCTIONS  
5074 FHD F01  
R/W  
ADDRESS  
Pin Name  
Function  
BUFFER  
DECODER  
INSTRUCTION  
REGISTER  
CS  
Chip Select  
DO(1)  
CLK  
DI(1)  
PE  
Serial Data Output  
Clock Input  
INSTRUCTION  
DECODER  
ADDRESS  
REGISTER  
ERR  
Serial Data Input  
Parity Enable  
STATUS  
REGISTER  
MEMORY  
POINTER  
ERR  
VCC  
GND  
Error Indication Pin  
+3V Power Supply  
Ground  
33C804 F02  
Note:  
(1) DI, DO may be tied together to form a common I/O.  
© 1998 by Catalyst Semiconductor, Inc.  
Characteristics subject to change without notice  
Doc. No. 25044-00 2/98  
1
1234567...14

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与CAT33C804AC相关器件

型号 品牌 获取价格 描述 数据表
CAT33C804ACC CATALYST

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 		EEPROM, 256X16, Serial, CMOS
CAT33C804ACI ETC

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