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C9806JBY

更新时间： 2024-02-09 10:15:18
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 时钟光电二极管外围集成电路晶体
页数 文件大小 规格书
16页 144K
描述
Processor Specific Clock Generator, 133.3MHz, CMOS, PDSO48, SSOP-48

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C9806JBY 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：SSOP
包装说明：SSOP-48针数：48
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.38
JESD-30 代码：R-PDSO-G48JESD-609代码：e0
长度：15.875 mm湿度敏感等级：1
端子数量：48最高工作温度：70 °C
最低工作温度：最大输出时钟频率：133.3 MHz
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：220主时钟/晶体标称频率：14.318 MHz
认证状态：Not Qualified座面最大高度：2.794 mm
最大供电电压：3.465 V最小供电电压：3.135 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：TIN LEAD端子形式：GULL WING
端子节距：0.635 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.5 mm
uPs/uCs/外围集成电路类型：CLOCK GENERATOR, PROCESSOR SPECIFICBase Number Matches：1

C9806JBY 数据手册

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APPROVED PRODUCT  
C9806J  
SMBUS Frequency Clock Generator for Advanced Mobile Pentium® III Applications.  
Product Features  
Frequency Table (MHz)  
•
•
•
•
•
•
•
•
•
•
•
•
•
•
•
•
Supports Advanced Mobile Pentium® III CPU.  
2 CPU clocks.  
7 independent SDRAM clocks for 3 SO DIMMs.  
Power Management hardware support.  
7 PCI synchronous clocks.  
< 175 pS skew CPU and SDRAM clocks.  
< 175 pS skew among PCI clocks.  
SMBUS 2-Wire serial interface  
Programmable registers featuring:  
Individual clock enable/disable  
Mode as Tri-state, test, or normal  
24/48 MHz selections  
S1  
S0  
CPU(0:1)  
PCI(_F,0:5)  
30  
0
0
60  
0
1
66.6  
33.3  
1
0
133.3  
100  
33.3  
1
1
33.3  
Table 1  
Enable/Disable SST  
Available in 48-pin SSOP and TSSOP packages  
Spread Spectrum Technology (SST)  
Dial-a-Frequency™ Feature  
Pin Configuration  
Block Diagram  
XIN  
REF1  
REF0  
VSS  
XIN  
XOUT  
S1  
VDD  
PCI_F  
PCI0  
VSS  
PCI1  
PCI2  
PCI3  
PCI4  
VDD  
PCI5  
VSS  
S0  
1
2
3
4
5
6
7
8
48  
47  
46  
45  
44  
43  
42  
41  
40  
39  
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
28  
27  
26  
25  
VDD  
REF3  
VDD  
REF2  
PWR_DWN#  
VSS  
CPU0  
CPU1  
VDDC  
SDRAM_IN  
SDRAM_FB  
VSS  
SDRAM0  
SDRAM1  
VDDS  
SDRAM2  
SDRAM3  
VSS  
SDRAM4  
SDRAM5  
VDDS  
36pF  
36pF  
500K  
VDD  
XOUT  
4
2
REF(0:3)  
CPU(0:1)  
VDDC  
Rin  
cpu  
9
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
VDD  
S1  
S0  
S1  
S0  
PCI(_F,0:5)  
pci  
7
7
PLL1  
VDDS  
SDRAM_IN  
SDRAM(_FB,0:5)  
CPU_STP#  
PCI_STP#  
PWR_DWN#  
CS#  
PS#  
PD#  
SDATA  
SCLK  
VDD  
SCLK  
SDATA  
C
D
VDD  
VDD  
I2CPMU  
24/48 MHz  
24/48 MHz  
1
1
24/48 MHz  
24/48 MHz  
VSS  
CPU_STOP#  
PCI_STP#  
VDD  
Rin  
48/24  
PLL2  
Fig.1  
Cypress Semiconductor Corporation  
525 Los Coches St.  
Document#: 38-07051 Rev. **  
5/23/2001  
Milpitas, CA 95035. Tel: 408-263-6300, Fax: 408-263-6571  
http://www.cypress.com  
Page 1 of 16  
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