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BH161543DGG

更新时间: 2024-11-25 22:13:59
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恩智浦 - NXP /
页数 文件大小 规格书
12页 89K
描述
16-bit latched transceiver with dual enable and master reset 3-State

BH161543DGG 技术参数

生命周期:Active零件包装代码:TSSOP
包装说明:TSSOP,针数:56
Reach Compliance Code:unknownHTS代码:8542.39.00.01
风险等级:5.5其他特性:WITH MASTER RESET
系列:ABTJESD-30 代码:R-PDSO-G56
长度:14 mm负载电容(CL):50 pF
逻辑集成电路类型:REGISTERED BUS TRANSCEIVER位数:8
功能数量:2端口数量:2
端子数量:56最高工作温度:85 °C
最低工作温度:-40 °C输出特性:3-STATE
输出极性:TRUE封装主体材料:PLASTIC/EPOXY
封装代码:TSSOP封装形状:RECTANGULAR
封装形式:SMALL OUTLINE, THIN PROFILE, SHRINK PITCH最大电源电流(ICC):19 mA
传播延迟(tpd):4.1 ns认证状态:Not Qualified
座面最大高度:1.2 mm最大供电电压 (Vsup):5.5 V
最小供电电压 (Vsup):4.5 V标称供电电压 (Vsup):5 V
表面贴装:YES技术:BICMOS
温度等级:INDUSTRIAL端子形式:GULL WING
端子节距:0.5 mm端子位置:DUAL
宽度:6.1 mmBase Number Matches:1

BH161543DGG 数据手册

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INTEGRATED CIRCUITS  
74ABT161543  
74ABTH161543  
16-bit latched transceiver with  
dual enable and master reset (3-State)  
Product specification  
1998 Feb 27  
Supersedes data of 1995 Sep 18  
IC23 Data Handbook  
Philips  
Semiconductors  

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