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Datasheet > 可编程逻辑 > 可编程逻辑器件> ATF22V10C-7JI
ATF22V10C-7JI PDF预览

ATF22V10C-7JI

更新时间： 2024-02-19 12:38:47
品牌 Logo 应用领域
爱特美尔 - ATMEL /
页数 文件大小 规格书
18页 262K
描述
Highperformance EE PLD

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ATF22V10C-7JI 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：TSSOP包装说明：TSSOP,
针数：24Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.43
其他特性：SHARED INPUT/CLOCK最大时钟频率：125 MHz
JESD-30 代码：R-PDSO-G24JESD-609代码：e3
长度：7.8 mm湿度敏感等级：2
专用输入次数：10I/O 线路数量：10
端子数量：24最高工作温度：70 °C
最低工作温度：组织：10 DEDICATED INPUTS, 10 I/O
输出函数：MACROCELL封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
可编程逻辑类型：FLASH PLD传播延迟：7.5 ns
认证状态：Not Qualified座面最大高度：1.2 mm
最大供电电压：5.25 V最小供电电压：4.75 V
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40宽度：4.4 mm
Base Number Matches：1

ATF22V10C-7JI 数据手册

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Features  
• Industry-standard Architecture  
– Low-cost, Easy-to-use Software Tools  
• High-speed, Electrically Erasable Programmable Logic Devices  
– 5 ns Maximum Pin-to-pin Delay  
• CMOS- and TTL-compatible Inputs and Outputs  
– Latch Feature Holds Inputs to Previous Logic States  
• Pin-controlled Standby Power (10 µA Typical)  
• Advanced Flash Technology  
– Reprogrammable  
– 100% Tested  
• High-reliability CMOS Process  
High-  
– 20-year Data Retention  
– 100 Erase/Write Cycles  
– 2,000V ESD Protection  
– 200 mA Latch-up Immunity  
performance  
EE PLD  
• Dual Inline and Surface Mount Packages in Standard Pinouts  
• PCI-compliant  
• True Input Transition Detection “Z” and “QZ” Version  
ATF22V10C  
ATF22V10CQ  
See separate datasheet  
for ATF22V10CZ and  
ATF22V10CQZ options.  
Pin Configurations  
TSSOP  
All Pinouts Top View  
CLK/IN  
1
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
14  
13  
VCC  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
IN  
IN  
2
Pin Name Function  
IN  
3
IN/PD  
4
CLK  
IN  
Clock  
IN  
IN  
5
6
Logic Inputs  
Bi-directional Buffers  
Ground  
IN  
7
IN  
8
I/O  
IN  
9
IN  
10  
11  
12  
GND  
VCC  
PD  
IN  
GND  
+5V Supply  
Power-down  
PLCC  
DIP/SOIC  
CLK/IN  
IN  
1
2
3
4
5
6
7
8
9
24 VCC  
23 I/O  
22 I/O  
21 I/O  
20 I/O  
19 I/O  
18 I/O  
17 I/O  
16 I/O  
15 I/O  
14 I/O  
13 IN  
IN  
IN/PD  
IN  
5
6
7
8
9
25 I/O  
24 I/O  
23 I/O  
22 GND*  
21 I/O  
20 I/O  
19 I/O  
IN/PD  
IN  
IN  
IN  
GND*  
IN  
IN  
IN  
IN 10  
IN 11  
IN  
IN 10  
IN 11  
GND 12  
Note:  
For all PLCCs (except “-5”), pins 1, 8, 15 and 22 can be  
left unconnected. However, if they are connected, supe-  
rior performance will be achieved.  
Rev. 0735P–PLD–01/02  
1234567...18

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