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5962-0720102M3A

更新时间： 2024-02-22 13:23:14

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爱特美尔 - ATMEL		可编程逻辑器件输入元件时钟
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25页	490K
描述
High-speed Complex Programmable Logic Device

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5962-0720102M3A 技术参数

是否Rohs认证：	不符合	生命周期：	Active
包装说明：	QCCN, LCC28,.45SQ	Reach Compliance Code：	compliant
ECCN代码：	3A001.A.2.C	HTS代码：	8542.39.00.01
风险等级：	5.15	Is Samacsys：	N
其他特性：	NO	最大时钟频率：	55 MHz
系统内可编程：	NO	JESD-30 代码：	S-CQCC-N28
JESD-609代码：	e0	JTAG BST：	NO
长度：	11.43 mm	专用输入次数：	11
I/O 线路数量：	10	宏单元数：	10
端子数量：	28	最高工作温度：	125 °C
最低工作温度：	-55 °C	组织：	11 DEDICATED INPUTS, 10 I/O
输出函数：	MACROCELL	封装主体材料：	CERAMIC, METAL-SEALED COFIRED
封装代码：	QCCN	封装等效代码：	LCC28,.45SQ
封装形状：	SQUARE	封装形式：	CHIP CARRIER
电源：	5 V	可编程逻辑类型：	EE PLD
传播延迟：	15 ns	认证状态：	Not Qualified
筛选级别：	MIL-STD-883	座面最大高度：	2.54 mm
子类别：	Programmable Logic Devices	最大供电电压：	5.5 V
最小供电电压：	4.5 V	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	MILITARY	端子面层：	TIN LEAD
端子形式：	NO LEAD	端子节距：	1.27 mm
端子位置：	QUAD	宽度：	11.43 mm
Base Number Matches：	1

5962-0720102M3A 数据手册

Features

• Advanced, High-speed, Electrically-erasable Programmable Logic Device

– Superset of 22V10

– Enhanced Logic Flexibility

– Backward Compatible with ATV750B/BL and ATV750/L

• Low-power Edge-sensing “L” Option with 1 mA Standby Current

• D- or T-type Flip-flop

• Product Term or Direct Input Pin Clocking for Flip-flop

• 7.5 ns Maximum Pin-to-pin Delay with 5V Operation

• Highest Density Programmable Logic Available in 24-pin and 28-pin Packages

– Advanced Electrically-erasable Technology

– Reprogrammable

High-speed

Complex

Programmable

Logic Device

– 100% Tested

• Increased Logic Flexibility

– 42 Array Inputs, 20 Sum Terms and 20 Flip-flops

• Enhanced Output Logic Flexibility

– All 20 Flip-flops Feed Back Internally

– 10 Flip-flops are also Available as Outputs

• Programmable Pin-keeper Circuits

• Dual-in-line and Surface Mount Package in Standard Pinouts

• Full Military, Commercial and Industrial Temperature Ranges

• 20-year Data Retention

ATF750C

ATF750CL

• 2000V ESD Protection

• 1000 Erase/Write Cycles

• Green Package Options (Pb/Halide-free/RoHS Compliant) Available

1. Block Diagram

(OE PRODUCT TERMS)

PROGRAMMABLE

INTERCONNECT

AND

COMBINATORIAL

LOGIC ARRAY

INPUT

PINS

LOGIC

OPTION

4 TO 8

PRODUCT

TERMS

I/O

PINS

OUTPUT

OPTION

(UP T0 20

FLIP-FLOPS)

(CLOCK PIN)

0776L–PLD–11/08

12 3 4 5 6 7...25

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