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Datasheet > 可编程逻辑 > 可编程逻辑器件> ATF22V10CZ-15XI
ATF22V10CZ-15XI PDF预览

ATF22V10CZ-15XI

更新时间： 2024-11-28 22:07:11
品牌 Logo 应用领域
爱特美尔 - ATMEL /
页数 文件大小 规格书
13页 276K
描述
Highperformance EE PLD

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ATF22V10CZ-15XI 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：TSSOP包装说明：TSSOP, TSSOP24,.25
针数：24Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.7
架构：PAL-TYPE最大时钟频率：55.5 MHz
JESD-30 代码：R-PDSO-G24JESD-609代码：e0
长度：7.8 mm湿度敏感等级：2
专用输入次数：11I/O 线路数量：10
输入次数：22输出次数：10
产品条款数：132端子数量：24
最高工作温度：85 °C最低工作温度：-40 °C
组织：11 DEDICATED INPUTS, 10 I/O输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP24,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：240
电源：5 V可编程逻辑类型：EE PLD
传播延迟：15 ns认证状态：Not Qualified
座面最大高度：1.2 mm子类别：Programmable Logic Devices
最大供电电压：5.5 V最小供电电压：4.5 V
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：4.4 mm
Base Number Matches：1

ATF22V10CZ-15XI 数据手册

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Features  
• Industry-standard Architecture  
• 12 ns Maximum Pin-to-pin Delay  
• Zero Power – 25 µA Maximum Standby Power (Input Transition Detection)  
• CMOS and TTL Compatible Inputs and Outputs  
• Advanced Electrically-erasableTechnology  
– Reprogrammable  
– 100% Tested  
• Latch Feature Holds Inputs to Previous Logic State  
• High-reliability CMOS Process  
– 20 Year Data Retention  
– 100 Erase/Write Cycles  
– 2,000V ESD Protection  
High-  
performance  
EE PLD  
– 200 mA Latchup Immunity  
• Commercial and Industrial Temperature Ranges  
• Dual-in-line and Surface Mount Standard Pinouts  
• PCI Compliant  
Block Diagram  
ATF22V10CZ  
ATF22V10CQZ  
Description  
The ATF22V10CZ/CQZ is a high-performance CMOS (electrically-erasable)  
programmable logic device (PLD) which utilizes Atmel’s proven electrically-erasable  
(continued)  
Pin Configurations  
All Pinouts Top View  
TSSOP  
CLK/IN  
IN  
1
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
14  
13  
VCC  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
IN  
Pin Name Function  
2
IN  
3
CLK  
IN  
Clock  
IN  
4
IN  
5
Logic Inputs  
Bi-directional Buffers  
+5V Supply  
IN  
6
IN  
7
I/O  
IN  
8
IN  
9
VCC  
IN  
10  
11  
12  
IN  
PLCC  
GND  
DIP/SOIC  
IN  
IN  
IN  
5
6
7
8
9
25 I/O  
24 I/O  
23 I/O  
22 GND*  
21 I/O  
20 I/O  
19 I/O  
CLK/IN  
IN  
1
2
3
4
5
6
7
8
9
24 VCC  
23 I/O  
22 I/O  
21 I/O  
20 I/O  
19 I/O  
18 I/O  
17 I/O  
16 I/O  
15 I/O  
14 I/O  
13 IN  
GND*  
IN  
IN  
IN  
IN 10  
IN 11  
IN  
IN  
IN  
IN  
IN  
Rev. 0778H–03/01  
IN 10  
IN 11  
Note:  
For PLCC, P1, P8, P15 and P22 can be left  
unconnected. For superior performance, con-  
nect VCC to pin 1 and GND to 8, 15, and 22.  
GND 12  
1234567...13

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