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ATF1504AE-10AI100

更新时间： 2024-01-13 13:14:31

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爱特美尔 - ATMEL		时钟输入元件可编程逻辑
页数	文件大小	规格书
76页	584K
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EE PLD, 10ns, 64-Cell, CMOS, PQFP100, PLASTIC, TQFP-100

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ATF1504AE-10AI100 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	TFQFP, TQFP100,.63SQ
针数：	100	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.75
其他特性：	YES	最大时钟频率：	100 MHz
系统内可编程：	YES	JESD-30 代码：	S-PQFP-G100
JESD-609代码：	e0	JTAG BST：	YES
长度：	14 mm	湿度敏感等级：	3
专用输入次数：		I/O 线路数量：	64
宏单元数：	64	端子数量：	100
最高工作温度：	85 °C	最低工作温度：	-40 °C
组织：	0 DEDICATED INPUTS, 64 I/O	输出函数：	MACROCELL
封装主体材料：	PLASTIC/EPOXY	封装代码：	TFQFP
封装等效代码：	TQFP100,.63SQ	封装形状：	SQUARE
封装形式：	FLATPACK, THIN PROFILE, FINE PITCH	峰值回流温度（摄氏度）：	240
电源：	2.5/3.3,3.3 V	可编程逻辑类型：	EE PLD
传播延迟：	10 ns	认证状态：	Not Qualified
座面最大高度：	1.2 mm	子类别：	Programmable Logic Devices
最大供电电压：	3.6 V	最小供电电压：	3 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	14 mm
Base Number Matches：	1

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Features

• 2nd Generation EE Complex Programmable Logic Devices

– 3.0V to 3.6V Operating Range with 5V Tolerant I/Os

– 32 - 512 Macrocells with Enhanced Features

– Pin-compatible with Industry-standard Devices

– Speeds to 4.5 ns Maximum Pin-to-pin Delay

– Registered Operation to 225 MHz

• Enhanced Macrocells with Logic Doubling^™Features

– Bury Either Register or COM while Using the Other for Output

– Dual Independent Feedback Allows Multiple Latch Functions per Macrocell

– 5 Product Terms per Macrocell, Expandable to 40 per Macrocell with Cascade

Logic, Plus 15 More with Foldback Logic

– D/T/Latch Configurable Flip-flops plus Transparent Latches

– Global and/or per Macrocell Register Control Signals

– Global and/or per Macrocell Output Enable

– Programmable Output Slew Rate per Macrocell

– Programmable Output Open Collector Option per Macrocell

– Fast Registered Input from Product Term

• Enhanced Connectivity

ATF15xxAE

Family

Datasheet

ATF1502AE(L)

ATF1504AE(L)

ATF1508AE(L)

ATF1516AE(L)

ATF1532AE(L)

– Single Level Switch Matrix for Maximum Routing Options

– Up to 40 Inputs per Logic Block

• Advanced Power Management Features

– ITD (Input Transition Detection) Available Individually on Global Clocks, Inputs and

I/O for µA Level Standby Current on “L” versions

– Pin-controlled 1 mA Standby Mode

– Reduced-power Option per Macrocell

– Automatic Power Down of Unused Macrocells

– Programmable Pin-keeper Inputs and I/Os

• Available in Commercial and Industrial Temperature Ranges

• Available in All Popular Packages Including PLCC, PQFP, TQFP and BGA

• EE Technology

– 100% Tested

– Completely Reprogrammable

– 10,000 Program/Erase Cycles

Preliminary

– 20 Year Data Retention

– 2000V ESD Protection

– 200 mA Latch-up Immunity

• JTAG Boundary-scan Testing Port per IEEE 1149.1-1990 and 1149.1a-1993

– Pull-up Option on JTAG Pins TMS and TDI

• IEEE 1532 Compatibility for Fast In-System Programmability (ISP) via JTAG

• PCI-compliant

• Security Fuse Feature

Rev. 2398E–12/01

12 3 4 5 6 7...76

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