AT17N512-10PC

更新时间： 2024-10-26 22:23:07

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FPGA Configuration Memory

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AT17N512-10PC 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	DIP	包装说明：	DIP, DIP8,.3
针数：	8	Reach Compliance Code：	compliant
ECCN代码：	EAR99	HTS代码：	8542.32.00.51
风险等级：	5.92	最大时钟频率 (fCLK)：	15 MHz
数据保留时间-最小值：	20	耐久性：	10 Write/Erase Cycles
JESD-30 代码：	R-PDIP-T8	JESD-609代码：	e0
长度：	9.271 mm	内存密度：	524288 bit
内存集成电路类型：	CONFIGURATION MEMORY	内存宽度：	1
湿度敏感等级：	1	功能数量：	1
端子数量：	8	字数：	524288 words
字数代码：	512000	工作模式：	SYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	512KX1	封装主体材料：	PLASTIC/EPOXY
封装代码：	DIP	封装等效代码：	DIP8,.3
封装形状：	RECTANGULAR	封装形式：	IN-LINE
并行/串行：	SERIAL	峰值回流温度（摄氏度）：	225
电源：	3.3 V	认证状态：	Not Qualified
座面最大高度：	5.334 mm	最大待机电流：	0.0001 A
子类别：	EEPROMs	最大压摆率：	0.005 mA
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	3 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	NO
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	7.62 mm
Base Number Matches：	1

AT17N512-10PC 数据手册

Features

• EE Programmable 262,144 x 1-, 524,288 x 1-, 1,048,576 x 1-, 2,097,152 x 1-, and

4,194,304 x 1-bit Serial Memories Designed to Store Configuration Programs for Field

Programmable Gate Arrays (FPGAs)

• Available as a 3.3V ( 10%) Commercial and Industrial Version

• Simple Interface to SRAM FPGAs

• Pin Compatible with Xilinx^®XC17SXXXA and XC17SXXXXL PROMs

• Compatible with Xilinx Spartan^®-II, Spartan-IIE and Spartan XL FPGAs in Master Serial

Mode

• Very Low-power CMOS EEPROM Process

• Available in 6 mm x 6 mm x 1 mm 8-lead LAP (Pin-compatible with 8-lead SOIC/VOIC

Packages), 8-lead PDIP, 8-lead SOIC, 20-lead SOIC and 44-lead TQFP Packages for a

Specific Density

• Low-power Standby Mode

• High-reliability

FPGA

Configuration

Memory

– Endurance: Minimum 10 Write Cycles

– Data Retention: 20 Years at 85°C

AT17N256

AT17N512

AT17N010

AT17N002

AT17N040

Description

The AT17N series FPGA Configuration EEPROM (Configurators) provide an easy-to-

use, cost-effective configuration memory for Field Programmable Gate Arrays. The

AT17N series device is packaged in the 8-lead LAP, 8-lead PDIP, 8-lead SOIC, 20-lead

SOIC and 44-lead TQFP, see Table 1. The AT17N series Configurators uses a simple

serial-access procedure to configure one or more FPGA devices.

The AT17N series configurators can be programmed with industry-standard program-

mers, Atmel’s ATDH2200E Programming Kit or Atmel’s ATDH2225 ISP Cable and

factory programming.

Table 1. AT17N Series Packages

3.3V

AT17N512/

AT17N010

Package

AT17N256

AT17N002

AT17N040

System Support

8-lead LAP

8-lead PDIP

8-lead SOIC

20-lead SOIC

44-lead TQFP

–

Yes

–

Yes

–

Yes

–

Use 8-lead LAP⁽¹⁾

–

Yes

–

Yes

–

Yes

Note:

1. The 8-lead LAP package has the same footprint as the 8-lead SOIC. Since an 8-

lead SOIC package is not available for the AT17N512/010/002 devices, it is possi-

ble to use an 8-lead LAP package instead.

Rev. 3020A–CNFG–05/03

12 3 4 5 6 7...18

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AT17N512-10PC 替代型号

型号	品牌	替代类型	描述	数据表
AT17LV010-10PU	ATMEL	类似代替	FPGA Configuration EEPROM Memory

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型号	品牌	获取价格	描述	数据表
AT17N512-10PI	ATMEL	获取价格	FPGA Configuration Memory
AT17N512-10PJ	ATMEL	获取价格	Configuration Memory, 512KX1, Serial, CMOS, PDIP8, 0.300 INCH, PLASTIC, MS-001BA, DIP-8
AT17N512-10PL	ATMEL	获取价格	Configuration Memory, 512KX1, Serial, CMOS, PDIP8, 0.300 INCH, PLASTIC, MS-001BA, DIP-8
AT17N512-10SC	ATMEL	获取价格	FPGA Configuration Memory
AT17N512-10SI	ATMEL	获取价格	FPGA Configuration Memory
AT17N512-10SJ	ATMEL	获取价格	Configuration Memory, 512KX1, Serial, CMOS, PDSO20, 0.300 INCH, PLASTIC, SOIC-20
AT17N512-10SL	ATMEL	获取价格	Configuration Memory, 512KX1, Serial, CMOS, PDSO20, 0.300 INCH, PLASTIC, SOIC-20
AT-1820-TWT-1V-R	PUIAUDIO	获取价格	ALL DIMENSIONS ARE IN MILLIMETERS
AT-1820-TWT-6V-R	PUIAUDIO	获取价格	ALL DIMENSIONS ARE IN MILLIMETERS
AT1865	GMT	获取价格	41 Channel DC-DC converter for DV

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