AT17LV002-10BJC

更新时间： 2024-11-23 21:55:59

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FPGA Configuration EEPROM Memory

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AT17LV002-10BJC 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	LPCC	包装说明：	QCCJ, LDCC44,.7SQ
针数：	44	Reach Compliance Code：	unknown
ECCN代码：	EAR99	HTS代码：	8542.32.00.51
风险等级：	5.81	其他特性：	IT CAN OPERATES ON 4.75-5.25 RANGE SUPPLY VOLTAGE ALSO
最大时钟频率 (fCLK)：	15 MHz	JESD-30 代码：	S-PQCC-J44
JESD-609代码：	e0	长度：	16.586 mm
内存密度：	2097152 bit	内存集成电路类型：	CONFIGURATION MEMORY
内存宽度：	1	湿度敏感等级：	2
功能数量：	1	端子数量：	44
字数：	2097152 words	字数代码：	2000000
工作模式：	SYNCHRONOUS	最高工作温度：	70 °C
最低工作温度：		组织：	2MX1
封装主体材料：	PLASTIC/EPOXY	封装代码：	QCCJ
封装等效代码：	LDCC44,.7SQ	封装形状：	SQUARE
封装形式：	CHIP CARRIER	并行/串行：	SERIAL
峰值回流温度（摄氏度）：	225	电源：	3.3/5 V
认证状态：	Not Qualified	座面最大高度：	4.572 mm
最大待机电流：	0.00015 A	子类别：	EEPROMs
最大压摆率：	0.01 mA	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	3 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	J BEND	端子节距：	1.27 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	16.586 mm	Base Number Matches：	1

AT17LV002-10BJC 数据手册

Features

• EE Reprogrammable 2,097,152 x 1-bit Serial Memories Designed to Store

Configuration Programs for Field Programmable Gate Arrays (FPGAs)

• In-System Programmable via 2-wire Bus

• Simple Interface to SRAM FPGAs

• Compatible with Atmel AT6000, AT40K and AT94K Devices, Altera FLEX^®, APEX^™

Devices, Lucent ORCA^®FPGAs, Xilinx XC3000^™, XC4000^™, XC5200^™, Spartan^®,

Virtex^™FPGAs

• Cascadable Read Back to Support Additional Configurators or Higher-density Arrays

• Low-power CMOS EEPROM Process

• Programmable Reset Polarity

FPGA

• Available in 6 mm x 6 mm x 1 mm 8-lead LAP (Pin-compatible with 8-lead SOIC/VOIC

Packages), 20-lead PLCC, 44-lead PLCC and 44-lead TQFP Packages (Pin-compatible

Across Product Family)

Configuration

EEPROM

Memory

2-megabit

• Emulation of Atmel’s AT24CXXX Serial EEPROMs

• Available in 3.3V 10% LV and 5V 5% C Versions

• System-friendly READY Pin

• Low-power Standby Mode

• Replacement for AT17C/LV020

Description

The AT17C002 and AT17LV002 (high-density AT17 Series) FPGA Configuration

EEPROMs (Configurators) provide an easy-to-use, cost-effective configuration mem-

ory for programming Field Programmable Gate Arrays. The AT17 Series is packaged

in the popular 8-lead LAP, 20-lead PLCC, 44-lead PLCC and the 44-lead TQFP. The

AT17 Series family uses a simple serial-access procedure to configure one or more

FPGA devices. The user can select the polarity of the reset function by programming

four EEPROM bytes. These devices support a write protection mode and a system-

friendly READY pin, which signifies a “good” power level to the FPGA and can be used

to ensure reliable system power-up.

AT17C002

AT17LV002

The AT17 Series Configurators can be programmed with industry-standard program-

mers, Atmel’s ATDH2200E Programming System and Atmel’s ATDH2225 ISP Cable.

Rev. 2281D–12/01

12 3 4 5 6 7...19

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