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AS80SSTVF16857

更新时间: 2024-10-29 22:05:51
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ALSC 双倍数据速率
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12页 93K
描述
DDR 14-Bit Registered Buffer

AS80SSTVF16857 数据手册

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July 2003  
Advance Information  
PulseC re AS80SSTVF16857  
&
DDR 14-Bit Registered Buffer  
Recommended Applications  
Features  
DDR memory modules  
Provides complete DDR DIMM logic solution  
with PCV857  
Differential clock signals  
Meets SSTL_2 class II specifications on outputs  
Supports SSTL_2 Class I and II specifications  
SSTL_2-compatible data registers  
Low voltage operation – V = 2.3V to 2.7V  
DD  
Available in 48-pin TSSOP and TVSOP package  
Operates at 2.3V to 2.7V for PC1600, PC2100, and  
PC2700; 2.5V to 2.7V for PC3200  
Pinout and Functionality Compatible with JEDEC  
Standard SSTV16857  
Block Diagram  
Pin Configuration  
38  
39  
CLK  
CLKB  
Q1  
Q2  
D1  
1
2
48  
47  
D2  
GND  
VDDQ  
Q3  
GND  
VDD  
D3  
3
4
5
46  
45  
44  
34  
RESETB  
R
CLK  
Q1  
48  
6
7
43  
42  
Q4  
Q5  
D4  
D1  
35  
D5  
D1  
VREF  
GND  
VDDQ  
Q6  
D6  
8
41  
9
40  
D7  
10  
11  
12  
13  
39  
38  
37  
36  
CLKB  
CLK  
VDD  
GND  
VREF  
RESETB  
D8  
Q7  
VDDQ  
GND  
Q8  
To 13 other channels  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
35  
34  
33  
32  
31  
30  
29  
28  
27  
26  
25  
Q9  
VDDQ  
GND  
Q10  
Q11  
Q12  
VDDQ  
GND  
Q13  
Q14  
D9  
D10  
D11  
D12  
VDD  
GND  
D13  
D14  
48-Pin TSSOP & TVSOP  
6.10 mm body, 0.50 mm pitch = TSSOP  
4.40 mm body, 0.40 mm pitch = TSSOP (TVSOP)  
8/1/03; V.0.10  
Alliance Semiconductor  
P. 1 of 12  
ꢀꢁꢂꢃꢄꢅꢆꢇꢈꢉ'ꢉꢊꢋꢋꢅꢌꢍꢎꢏꢉꢐꢏꢑꢅꢎꢁꢍꢒꢓꢎꢈꢁꢄꢔꢉꢊꢋꢋꢉꢄꢅꢆꢇꢈꢕꢉꢄꢏꢕꢏꢄꢖꢏꢒꢔ  

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D Flip-Flop, SSTV Series, 1-Func, Positive Edge Triggered, 13-Bit, True Output, MLF2-56