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ALVD-0.750MHZ-D-H-C

更新时间： 2024-02-28 09:19:34

品牌	Logo	应用领域
ABRACON		机械振荡器
页数	文件大小	规格书
3页	1702K
描述
CMOS Output Clock Oscillator, 0.75MHz Nom, ROHS COMPLIANT, CERAMIC, SMD, 6 PIN

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ALVD-0.750MHZ-D-H-C 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	Reach Compliance Code：	compliant
风险等级：	5.6	其他特性：	TRI-STATE; ENABLE/DISABLE FUNCTION; BULK
最大控制电压：	3 V	最小控制电压：	0.3 V
最长下降时间：	1.6 ns	频率调整-机械：	NO
频率偏移/牵引率：	50 ppm	频率稳定性：	35%
安装特点：	SURFACE MOUNT	标称工作频率：	0.75 MHz
最高工作温度：	60 °C	最低工作温度：	-10 °C
振荡器类型：	CMOS	输出负载：	10 pF
物理尺寸：	7.0mm x 5.0mm x 1.8mm	最长上升时间：	1.6 ns
最大供电电压：	3.63 V	最小供电电压：	2.97 V
标称供电电压：	3.3 V	表面贴装：	YES
最大对称度：	55/45 %	Base Number Matches：	1

ALVD-0.750MHZ-D-H-C 数据手册

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CERAMIC SMD CRYSTAL CLOCK OSCILLATOR

WITH VOLTAGE CONTROL

ALVD

RoHS

7.0 x 5.0 x 1.8mm

Compliant

FEATURES:

APPLICATIONS:

• Based on a proprietary digital multiplier

• Tri-State Output

• SONET, xDSL

• SDH, CPE

• STB

• Low Phase Jitter

• 3.3V +/- 5% operation

• Ceramic SMD, low profile package

STANDARD SPECIFICATIONS:

ARAMETERS

ABRACON P/N:

ALVD Series

Frequency range:

750 KHz to 800 MHz

0°C to +70°C (see options)

-55°C to +125°C

Operating temperature:

Storage temperature:

Overall frequency stability:

Supply voltage (V_dd):

±50 ppm max. (see options)

3.3V ± 10%

Voltage control (V_C):

Symmetry at 1/2 Vdd:

Output Level:

0.3VDC min, 1.65VDC typ, 3.0 VDC max.

40/60% max.

See options (PECL, CMOS, or LVDS)

± 50ppm (see option)

Pullability:

Tristate Function:

"1" (V^IH>= 0.7* Vdd) or open: Oscillation

"0" (V^IL< 0.3* Vdd) : Hi Z

±5 ppm max.

Aging per year:

RMS Phase Jitter:

Period Jitter (peak to peak):

Phase Noise:

3ps typical, 5ps max. (12KHz~20MHz)

35 ps typical

-112 dBc/Hz @ 1kHz Offset from 155.52MHz

-125 dBc/Hz @ 10kHz Offset from 155.52MHz

-123 dBc/Hz @ 100KHz Offset from 155.52MHz

-109 dBc/Hz @ 1kHz Offset from 622.08MHz

-110 dBc/Hz @ 10kHz Offset from 622.08MHz

-109 dBc/Hz @ 100KHz Offset from 622.08MHz

PECL:

Supply current (I_DD):

25mA max (for Fo<24MHz),65mA max (for 24MHz<Fo<96MHz),100mA max (96MHz<Fo<700MHz)

Output Logic High: V_dd-1.025V min, V_dd-0.880V max.

Output Logic Low: V_dd-1.810V min. V_dd-1.620V max.

Symmetry (Duty Cycle): 45% min, 50% typ, 55% max,

Rise time: 0.6nSec typ,1.5nS max

Fall time: 0.6nSec typ, 1.5nS max

CMOS:

Supply current (I_DD):15

mA max (for Fo<24MHz),30mA max (for 24MHz<Fo<96MHz), 40mA max (96MHz<Fo<700MHz)

Output Clock Rise/ Fall Time [10%~90% VDD with 10pF load]: 1.2ns typ, 1.6ns max.

Output Clock Duty Cycle [Measured @ 50% VDD]: 45% min, 50% typical, 55% max

LVDS:

Supply current (I_DD):25

mA max (for Fo<24MHz),45mA max (for 24MHz<Fo<96MHz),80mA max (96MHz<Fo<700MHz)

Output Clock Duty Cycle @ 1.25V: 45% min, 50% typical, 55% max

Output Differential Voltage (V_OD): 247mV min, 355mV typical, 454mV max

VDD Magnitude Change (? V_OD): -50mV min, 50mV max

Output High Voltage : V_OH= 1.4V typical, 1.6V max.

Output Low Voltage: V_OL= 0.9V min, 1.1V typical

Offset Voltage [R_L= 100?? : V_OS= 1.125V min, 1.2V typical, 1.375V max

Offset Magnitude Change [R_L= 100?? : ? V_OS= 0mV min, 3mV typical, 25mV max

Power-off Leakage (I_OXD) [Vout=VDD or GND, VDD=0V] = ±1?A typical, ±10?A max.

Differential Clock Rise Time (t_r) [R_L=100? , CL=10pF]: 0.2nS min, 0.7nS typical, 1.0nS,max

Differential Clock Fall Time (t_f) [R_L=100? , CL=10pF]: 0.2nS min, 0.7nS typical, 1.0nS max

Visit www.abracon.com for Terms & Conditions of Sale Revised: 07.22.09

30332 Esperanza, Rancho Santa Margarita, California 92688

tel 949-546-8000 | fax 949-546-8001| www.abracon.com

ABRACON IS

ISO 9001 / QS 9000

CERTIFIED

12 3

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