Datasheet > 微控制器和处理器 > 数字信号处理器> ADSP-BF561SBBCZ-5A

ADSP-BF561SBBCZ-5A

更新时间： 2024-01-22 18:08:46

品牌	Logo	应用领域
亚德诺 - ADI		微控制器和处理器外围集成电路数字信号处理器时钟
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64页	2516K
描述
Blackfin Embedded Symmetric Multiprocessor

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ADSP-BF561SBBCZ-5A 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	BGA
包装说明：	BGA,	针数：	256
Reach Compliance Code：	unknown	风险等级：	5.61
Is Samacsys：	N	其他特性：	ALSO OPERATES AT 2.5 OR 3.3 V NOMINAL SUPPLY
地址总线宽度：	23	桶式移位器：	YES
边界扫描：	YES	最大时钟频率：	500 MHz
外部数据总线宽度：	32	格式：	FIXED POINT
内部总线架构：	MULTIPLE	JESD-30 代码：	S-PBGA-B256
JESD-609代码：	e1	长度：	17 mm
低功率模式：	YES	湿度敏感等级：	3
端子数量：	256	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	BGA	封装形状：	SQUARE
封装形式：	GRID ARRAY	峰值回流温度（摄氏度）：	260
认证状态：	COMMERCIAL	座面最大高度：	1.9 mm
最大供电电压：	1.375 V	最小供电电压：	0.8 V
标称供电电压：	1.25 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子面层：	TIN SILVER COPPER
端子形式：	BALL	端子节距：	1 mm
端子位置：	BOTTOM	处于峰值回流温度下的最长时间：	40
宽度：	17 mm	uPs/uCs/外围集成电路类型：	DIGITAL SIGNAL PROCESSOR, OTHER
Base Number Matches：	1

ADSP-BF561SBBCZ-5A 数据手册

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Blackfin Embedded

Symmetric Multiprocessor

ADSP-BF561

2 internal memory-to-memory DMAs and 1 internal memory

DMA controller

12 general-purpose 32-bit timers/counters with PWM

capability

SPI-compatible port

UART with support for IrDA

Dual watchdog timers

Dual 32-bit core timers

48 programmable flags (GPIO)

On-chip phase-locked loop capable of 0.5× to 64× frequency

multiplication

FEATURES

Dual symmetric 600 MHz high performance Blackfin cores

328K bytes of on-chip memory

(see Memory Architecture on Page 4)

Each Blackfin core includes

Two 16-bit MACs, two 40-bit ALUs, four 8-bit video ALUs,

40-bit shifter

RISC-like register and instruction model for ease of pro-

gramming and compiler-friendly support

Advanced debug, trace, and performance monitoring

Wide range of operating voltages, (see Operating Conditions

on Page 20)

2 parallel input/output peripheral interface units supporting

ITU-R 656 video and glueless interface to analog front end

ADCs

256-ball CSP_BGA (2 sizes) and 297-ball PBGA

package options

2 dual channel, full duplex synchronous serial ports support-

ing eight stereo I²S channels

PERIPHERALS

Dual 12-channel DMA controllers

(supporting 24 peripheral DMAs)

2 memory-to-memory DMAs

JTAG TEST

VOLTA

IRQ CONTROL/

WATCHDOG

TIMER

EMULATION

REGULA

UART

IrDA

SPI

DATA

MEMORY

L2 SRAM

DATA

INSTRUCTION

MEMORY

INSTRUCTION

MEMORY

128K BYTES

MEMORY

SPORT0

SPORT1

GPIO

IMDMA

CONTROLLER

CORE SYSTEM/BUS INTERFACE

EAB

DMA

CONTROLLER1

TIMERS

DMA

CONTROLLER2

DEB

DAB

BOOT ROM

DAB

PAB

EXTERNAL PORT

FLASH/SDRAM CONTROL

PPI0

PPI1

Figure 1. Functional Block Diagram

Blackfin and the Blackfin logo are registered trademarks of Analog Devices, Inc.

Rev. E

Information furnished by Analog Devices is believed to be accurate and reliable.

However, no responsibility is assumed by Analog Devices for its use, nor for any

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Specifications subject to change without notice. No license is granted by implication

or otherwise under any patent or patent rights of Analog Devices. Trademarks and

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One Technology Way, P.O. Box 9106, Norwood, MA 02062-9106 U.S.A.

Tel: 781.329.4700

Fax: 781.461.3113

www.analog.com

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