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ADS5404IZAYR

更新时间： 2024-11-29 12:28:11
品牌 Logo 应用领域
德州仪器 - TI 转换器
页数 文件大小 规格书
40页 1093K
描述
Dual Channel 12-Bit 500Msps Analog-to-Digital Converter

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ADS5404IZAYR 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：BGA
包装说明：NFBGA-196针数：196
Reach Compliance Code：compliantECCN代码：3A001.A.5.A.3
HTS代码：8542.39.00.01风险等级：5.44
最大模拟输入电压：1.25 V最小模拟输入电压：-1 V
转换器类型：ADC, PROPRIETARY METHODJESD-30 代码：S-PBGA-B196
JESD-609代码：e1长度：12 mm
最大线性误差 (EL)：0.1221%湿度敏感等级：3
模拟输入通道数量：2位数：12
功能数量：1端子数量：196
最高工作温度：85 °C最低工作温度：-40 °C
输出位码：OFFSET BINARY, 2'S COMPLEMENT BINARY输出格式：PARALLEL, WORD
封装主体材料：PLASTIC/EPOXY封装代码：LFBGA
封装等效代码：BGA196,14X14,32封装形状：SQUARE
封装形式：GRID ARRAY, LOW PROFILE, FINE PITCH峰值回流温度（摄氏度）：260
电源：1.8,3.3 V认证状态：Not Qualified
采样速率：500 MHz采样并保持/跟踪并保持：TRACK
座面最大高度：1.4 mm子类别：Analog to Digital Converters
最大压摆率：330 mA标称供电电压：1.8 V
表面贴装：YES技术：BIPOLAR
温度等级：INDUSTRIAL端子面层：Tin/Silver/Copper (Sn/Ag/Cu)
端子形式：BALL端子节距：0.8 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：12 mmBase Number Matches：1

ADS5404IZAYR 数据手册

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ADS5404  
www.ti.com  
SLAS945 –APRIL 2013  
Dual Channel 12-Bit 500Msps Analog-to-Digital Converter  
Check for Samples: ADS5404  
1
FEATURES  
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•
Dual Channel  
APPLICATIONS  
12-Bit Resolution  
•
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•
Test and Measurement Instrumentation  
Maximum Clock Rate: 500 Msps  
Low Swing Fullscale Input: 1.0 Vpp  
Analog Input Buffer with High Impedance Input  
Input Bandwidth (3 dB): >1.2 GHz  
Data Output Interface: DDR LVDS  
196-Pin BGA Package (12x12mm)  
Power Dissipation: 910 mW/ch  
Performance at fin = 230 MHz IF  
Ultra-Wide Band Software Defined Radio  
Data Acquisition  
Power Amplifier Linearization  
Signal Intelligence and Jamming  
Radar and Satellite Systems  
Microwave Receivers  
Number of  
Channels  
Device Part No.  
Speed Grade  
–
–
SNR: 60.6 dBFS  
SFDR: 77 dBc  
ADS5402  
ADS5401  
ADS5404  
ADS5403  
2
1
2
1
800Msps  
800Msps  
500Msps  
500Msps  
•
Performance at fin = 700 MHz IF  
–
–
SNR: 59.4 dBFS  
SFDR: 70 dBc  
DESCRIPTION  
The ADS5404 is a high linearity dual channel 12-bit, 500 MSPS analog-to-digital converter (ADC) easing front  
end filter design for wide bandwidth receivers. The analog input buffer isolates the internal switching of the on-  
chip track-and-hold from disturbing the signal source as well as providing a high-impedance input. Optionally the  
output data can be decimated by two. Designed for high SFDR, the ADC has low-noise performance and  
outstanding spurious-free dynamic range over a large input-frequency range. The device is available in a 196-pin  
BGA package and is specified over the full industrial temperature range (–40°C to 85°C).  
12bit  
500Msps  
Digital  
Block  
INA  
DA[11:0]  
DACLK  
Clk  
Buffer  
CLKIN  
SYNCIN  
12bit  
500Msps  
Digital  
Block  
INB  
DB[11:0]  
DBCLK  
1
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of the Texas  
Instruments standard warranty. Production processing does not  
necessarily include testing of all parameters.  
Copyright © 2013, Texas Instruments Incorporated  
1234567...40

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