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Datasheet > 转换器 > 数模转换器> AD5380BST-5-REEL
AD5380BST-5-REEL PDF预览

AD5380BST-5-REEL

更新时间： 2024-01-24 00:52:14
品牌 Logo 应用领域
亚德诺 - ADI 转换器数模转换器
页数 文件大小 规格书
28页 800K
描述
IC PARALLEL, WORD INPUT LOADING, 8 us SETTLING TIME, 14-BIT DAC, PQFP100, 14 X 14 MM, MS-026BED, LQFP-100, Digital to Analog Converter

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AD5380BST-5-REEL 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：14 X 14 MM, MS-026BED, LQFP-100
针数：100Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.63最大模拟输出电压：5.5 V
最小模拟输出电压：转换器类型：D/A CONVERTER
输入位码：BINARY输入格式：PARALLEL, WORD
JESD-30 代码：S-PQFP-G100JESD-609代码：e0
长度：14 mm最大线性误差 (EL)：0.0244%
湿度敏感等级：3位数：14
功能数量：1端子数量：100
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装等效代码：QFP100,.63SQ,20封装形状：SQUARE
封装形式：FLATPACK, LOW PROFILE, FINE PITCH峰值回流温度（摄氏度）：240
电源：3/5,5 V认证状态：Not Qualified
座面最大高度：1.6 mm最大稳定时间：10 µs
标称安定时间 (tstl)：8 µs子类别：Other Converters
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn85Pb15)端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：14 mm
Base Number Matches：1

AD5380BST-5-REEL 数据手册

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32-Channel, 14-Bit, Parallel and  
Serial Input, Bipolar Voltage Output DAC  
Preliminary Technical Data  
AD5378  
Interface options  
Parallel interface  
FEATURES  
32-channel DAC in 13 mm × 13 mm 108-lead CSPBGA  
Guaranteed monotonic to 14 bits  
Buffered voltage outputs  
Output voltage span of 3.5 V × VREF(+)  
Maximum output voltage span of 17.5 V  
DSP/microcontroller-compatible 3-wire serial interface  
2.5 V to 5.5 V JEDEC-compliant digital levels  
SDO daisy-chaining option  
Power-on reset  
Digital reset (RESET pin and soft reset function)  
System calibration function allowing user-programmable  
offset and gain  
Pseudo differential outputs relative to REFGND  
Clear function to user-defined REFGND (CLR pin)  
Simultaneous update of DAC outputs (LDAC pin)  
DAC increment/decrement mode  
APPLICATIONS  
Level setting in automatic test equipment (ATE)  
Variable optical attenuators (VOAs)  
Optical switches  
Industrial control systems  
Channel grouping and addressing features  
FUNCTIONAL BLOCK DIAGRAM  
V
V
V
AGND  
DGND  
LDAC  
V
V
1(+)  
V
1(–) REFGND A1  
CC  
DD  
SS  
BIAS  
REF  
REF  
VBIAS  
AD5378  
POWER-ON  
RESET  
CLR  
RESET  
DCEN/WR  
SYNC/CS  
REG0  
INPUT  
REG  
0–1  
DAC  
REG  
0–1  
14  
14  
14  
14  
14  
14  
VOUT 0  
VOUT 1  
DAC 0–1  
/
/
/
/
/
/
m REG0–1  
c REG0–1  
REG1  
14  
/
DB13  
SCLK/DB12  
DIN/DB11  
INPUT  
REG  
2
DAC  
REG  
2
14  
/
14  
/
DAC 2  
VOUT 2  
VOUT 3  
DB0  
m REG2  
c REG2  
14  
/
A7  
14  
/
A0  
VOUT 4  
VOUT 5  
INPUT  
REG  
5
DAC  
REG  
5
14  
14  
14  
14  
SER/PAR  
DIN  
DAC 5  
/
/
/
/
/
/
SCLK  
SDO  
m REG7  
c REG7  
14  
/
FIFOEN  
REFGND B1  
REFGND B2  
REFGND C1  
REFGND C2  
REFGND D1  
REFGND D2  
INPUT  
REG  
6–7  
DAC  
REG  
6–7  
14  
/
14  
/
14  
14  
VOUT 6  
DAC 6–7  
VOUT 7  
VOUT 8  
m REG8–9  
c REG8–9  
14  
/
×4  
VOUT 31  
BUSY  
V
2(+)  
V
2(–) REFGND A2  
REF  
REF  
Figure 1.  
Protected by U.S. Patent No. 5,969,657 and 6,823,416; other patents pending.  
Rev. PrA  
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One Technology Way, P.O. Box 9106, Norwood, MA 02062-9106, U.S.A.  
Tel: 781.329.4700  
Fax: 781.326.8703  
www.analog.com  
© 2005 Analog Devices, Inc. All rights reserved.  
1234567...28

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