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AB-557-03-HCHC-S-L-C-T

更新时间： 2024-01-29 07:40:14

品牌	Logo	应用领域
ABRACON		晶体时钟发生器输出元件 PC
页数	文件大小	规格书
7页	3845K
描述
PLL Based Clock Driver, 557 Series, 2 True Output(s), 2 Inverted Output(s), PDSO16, TSSOP-16

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AB-557-03-HCHC-S-L-C-T 技术参数

是否Rohs认证：	符合	生命周期：	Active
零件包装代码：	TSSOP	包装说明：	TSSOP,
针数：	16	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.55
系列：	557	输入调节：	STANDARD
JESD-30 代码：	R-PDSO-G16	长度：	5 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	湿度敏感等级：	3
功能数量：	1	反相输出次数：	2
端子数量：	16	实输出次数：	2
最高工作温度：	105 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	260
座面最大高度：	1.1 mm	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	2.25 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	40	宽度：	4.4 mm
最小 fmax：	460 MHz	Base Number Matches：	1

AB-557-03-HCHC-S-L-C-T 数据手册

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CRYSTAL-LESS PCI EXPRESS DUAL OUTPUT ULTRA MINIATURE

PURE SILICON^TMSMD CLOCK GENERATOR

Moisture Sensitivity Level

MSL 1 – 14 QFN

MSL 3 – 16 TSSOP

AB-557-03 Series

3.2 x 2.5 x 0.85 mm (14 Pin QFN)

5.1 x 4.5 x 1.1 mm (16 Pin TSSOP)

RoHS

Compliant

FEATURES:

APPLICATIONS:

• Solid State Storage

• Storage Area Networks

• Passive Optical Networks

• Ethernet: 1G, 10GBASE-T/KR/LR/SR, and FCoE

• TV and other Consumer Electronics

• Industrial and Medical

• Meets PCIe Gen1, Gen2, & Gen3 specs.

• High Performance MEMS Technology by Discera

• Available Mixed Output Formats: HCSL, LVPECL, LVDS or LVCMOS

• Wide Temperature Range: -40° to 105° C

• Wide Supply Range: 2.25V to 3.6 V

• Low Power Consumption

• Scanner, Printer

• Excellent Shock & Vibration Immunity

STANDARD SPECIFICATIONS:

Parameters

Minimum

2.3

Typical

Maximum Unite

Notes

Frequency

f₀

100

460^*1

+70

MHz

°C

Operating Temperature

Storage Temperature

Overall Freq. Stability^*2

Supply Voltage

-20

-55

-50

+2.25

See options

+150

+50

+3.6

°C

Δf

V_DD

ppm See options

R_L=50Ω,

F₀₁=F₀₂=100.00MHz

Supply Current- Enabled

I_DD

Supply Current- Disabled

Startup Time

Enable Time

I_DD

t_su

t_EN

t_DA

Disable Time

"1" (VIH≥0.75*Vdd) or Open: Oscillation

"0" (VIL<0.25*Vdd) : Hi Z

40kΩ pull-up resistor

embedded

Tri-state Function (Standby/Disable)

Aging

-5.0

+5.0

ppm First year

V_OH

Output Offset Voltage

V_OL

0.725

R_L=50 Ω

0.10

Peak to Peak Output Swing

Rise Time

Fall Time

Duty Cycle

Period Jitter

750

ps_RMS

Single-Ended

R_L=50 Ω, C_L=2pF

(20% to 80%)*VDD

Differential

F₀₁=F₀₂=100.00MHz

t_r

t_f

200

400

SYM

J_PER

R_J

D_J

T_J

2.5

0.540

0.832

8.536

PCIe Gen 1.1

T_J= D_J+ 14.069 x R_J

(BER 10-12)

41.9

86.0

ps_p-p

Integrated Phase Noise

(Common Clock

Architecture)

PCIe Gen 2.1

1.5 MHz to Nyquist

PCIe Gen 2.1

10kHz to 1.5 MHz

J_RMS-CCHF

0.458

3.1

ps_RMS

J_RMS-CCLF

J_RMS-CC

0.030

0.165

0.561

3.0

1.0

4.0

ps_RMSPCIe Gen 3.0

PCIe Gen 2.1

J_RMS-DCHF

1.5 MHz to Nyquist

PCIe Gen 2.1

10kHz to 1.5 MHz

PCIe Gen 3.0

ps_RMS

Integrated Phase Noise

(Data Clock Architecture)

J_RMS-DCLF

J_RMS-DC

1.778

0.147

7.5

1.0

ps_RMS

*1. For frequency other than 100MHz, please contact ABRACON or consider using ASEMDxx series

2. Frequency stability includes frequency variations due to initial tolerance, temp. and power supply voltage

Visit www.abracon.com for Terms & Conditions of Sale

Revised: 10.31.12

30332 Esperanza, Rancho Santa Margarita, California 92688

tel 949-546-8000 | fax 949-546-8001| www.abracon.com

ABRACON IS

ISO9001:2008

CERTIFIED

12 3 4 5 6 7

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型号	品牌	描述	获取价格	数据表
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