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54ACT11000

更新时间： 2024-01-03 19:39:03
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德州仪器 - TI 输入元件
页数 文件大小 规格书
5页 70K
描述
QUADRUPLE 2-INPUT POSITIVE-NAND GATES

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54ACT11000 技术参数

生命周期：Obsolete零件包装代码：DIP
包装说明：0.300 INCH, CERAMIC, DIP-16针数：16
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.47Is Samacsys：N
其他特性：CENTER PIN VCC AND GND系列：ACT
JESD-30 代码：R-GDIP-T16长度：19.56 mm
负载电容（CL）：50 pF逻辑集成电路类型：NAND GATE
最大I（ol）：0.024 A功能数量：4
输入次数：2端子数量：16
最高工作温度：125 °C最低工作温度：-55 °C
封装主体材料：CERAMIC, GLASS-SEALED封装代码：DIP
封装等效代码：DIP16,.3封装形状：RECTANGULAR
封装形式：IN-LINE电源：5 V
Prop。Delay @ Nom-Sup：13.3 ns传播延迟（tpd）：9.5 ns
认证状态：Not Qualified施密特触发器：NO
座面最大高度：5.08 mm子类别：Gates
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：CMOS温度等级：MILITARY
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL宽度：7.62 mm
Base Number Matches：1

54ACT11000 数据手册

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54ACT11000, 74ACT11000  
QUADRUPLE 2-INPUT POSITIVE-NAND GATES  
SCAS002A – D2957, JUNE 1987 – REVISED APRIL 1993  
54ACT11000 . . . J PACKAGE  
74ACT11000 . . . D OR N PACKAGE  
• Inputs Are TTL-Voltage Compatible  
• Flow-Through Architecture Optimizes  
(TOP VIEW)  
PCB Layout  
• Center-Pin V  
and GND Configurations  
Minimize High-Speed Switching Noise  
CC  
1B  
2A  
2B  
V
1A  
1Y  
2Y  
GND  
GND  
3Y  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
• EPIC (Enhanced-Performance Implanted  
CMOS) 1- m Process  
CC  
V
• 500-mA Typical Latch-Up Immunity at 125°C  
CC  
3A  
3B  
4A  
• Package Options Include Plastic  
Small-Outline Packages, Ceramic Chip  
Carriers, and Standard Plastic and  
Ceramic 300-mil DIPs  
4Y  
4B  
description  
54ACT11000 . . . FK PACKAGE  
(TOP VIEW)  
These devices contain four independent 2-input  
NAND gates. They perform the Boolean functions  
Y = A B or Y = A + B in positive logic.  
The 54ACT11000 is characterized for operation  
over the full military temperature range of – 55°C  
to 125°C. The 74ACT11000 is characterized for  
operation from – 40°C to 85°C.  
3
2
1
20 19  
18  
3B  
4A  
NC  
4B  
4Y  
2A  
1B  
NC  
1A  
1Y  
4
5
6
7
8
17  
16  
15  
14  
FUNCTION TABLE  
(each gate)  
9 10 11 12 13  
INPUTS  
OUTPUT  
Y
A
B
H
X
L
H
L
L
H
H
NC – No internal connection  
X
†
logic symbol  
logic diagram (positive logic)  
1
1A  
16  
1A  
1Y  
1B  
&
2
3
6
7
1Y  
2Y  
3Y  
4Y  
1B  
15  
2A  
2Y  
2B  
2A  
14  
2B  
11  
3A  
10  
3A  
3Y  
3B  
3B  
9
4A  
8
4A  
4Y  
4B  
4B  
†
This symbol is in accordance with ANSI/IEEE Std 91-1984  
and IEC Publication 617-12.  
Pin numbers shown are for the D, J, and N packages.  
EPIC is a trademark of Texas Instruments Incorporated.  
Copyright 1993, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
2–1  
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
12345

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型号 品牌 描述 获取价格 数据表
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