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9LPRS501YGLFT PDF预览

9LPRS501YGLFT

更新时间： 2024-01-05 07:52:44
品牌 Logo 应用领域
艾迪悌 - IDT 稳压器电阻器微控制器和处理器外围集成电路uCs集成电路uPs集成电路光电二极管
页数 文件大小 规格书
28页 266K
描述
64-PIN CK505 W/FULLY INTEGRATED VOLTAGE REGULATOR + INTEGRATED SERIES RESISTOR

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9LPRS501YGLFT 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：DFN
包装说明：ROHS COMPLIANT, PLASTIC, MLF-64针数：64
Reach Compliance Code：compliantHTS代码：8542.31.00.01
风险等级：5.62Is Samacsys：N
JESD-30 代码：S-PQCC-N64JESD-609代码：e3
长度：9 mm端子数量：64
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：HVQCCN
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260认证状态：Not Qualified
座面最大高度：1 mm最大供电电压：3.465 V
最小供电电压：3.135 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：MATTE TIN
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：9 mmuPs/uCs/外围集成电路类型：MICROPROCESSOR CIRCUIT
Base Number Matches：1

9LPRS501YGLFT 数据手册

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Datasheet  
ICS9LPRS501  
64-PIN CK505 W/FULLY INTEGRATED VOLTAGE  
REGULATOR + INTEGRATED SERIES RESISTOR  
Recommended Application:  
CK505 compliant clock with fully integrated voltage  
regulator and Internal series resistor on differential outputs,  
PCIe Gen 1 compliant  
Key Specifications:  
•
•
•
•
CPU outputs cycle-cycle jitter < 85ps  
SRC output cycle-cycle jitter < 125ps  
PCI outputs cycle-cycle jitter < 250ps  
+/- 100ppm frequency accuracy on CPU & SRC  
clocks  
Output Features:  
•
•
•
2 - CPU differential low power push-pull pairs  
Features/Benefits:  
10 - SRC differential low power push-pull pairs  
•
•
•
•
Does not require external pass transistor for voltage  
regulator  
1 - CPU/SRC selectable differential low power push-pull  
pair  
Integrated series resistors on differential outputs,  
Zo=50Ω  
•
1 - SRC/DOT selectable differential low power push-pull  
pair  
Supports spread spectrum modulation, default is 0.5%  
down spread  
•
•
•
•
5 - PCI, 33MHz  
Uses external 14.318MHz crystal, external crystal  
load caps are required for frequency tuning  
1 - PCI_F, 33MHz free running  
1 - USB, 48MHz  
•
One differential push-pull pair selectable between  
SRC and two single-ended outputs  
1 - REF, 14.318MHz  
Table 1: CPU Frequency Select Table  
TSSOP Pin Configuration  
FSLC2  
FSLB1  
FSLA1  
PCI0/CR#_A 1  
VDDPCI 2  
64 SCLK  
63 SDATA  
CPU  
MHz  
SRC  
MHz  
PCI  
REF  
MHz  
USB  
MHz  
DOT  
MHz  
MHz  
B0b7  
B0b6  
B0b5  
PCI1/CR#_B 3  
PCI2/TME 4  
62 REF0/FSLC/TEST_SEL  
61 VDDREF  
60 X1  
59 X2  
58 GNDREF  
57 FSLB/TEST_MODE  
56 CK_PWRGD/PD#  
55 VDDCPU  
54 CPUT0  
53 CPUC0  
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
266.66  
133.33  
200.00  
166.66  
333.33  
100.00  
400.00  
PCI3 5  
100.00  
33.33 14.318 48.00  
Reserved  
96.00  
PCI4/SRC5_EN 6  
PCI_F5/ITP_EN 7  
GNDPCI 8  
VDD48 9  
USB_48MHz/FSLA 10  
GND48 11  
VDD96_IO 12  
DOTT_96/SRCT0 13  
DOTC_96/SRCC0 14  
GND 15  
1. FSLA and FSLB are low-threshold inputs.Please see VIL_FS and VIH_FS specifications in  
the Input/Supply/Common Output Parameters Table for correct values.  
Also refer to the Test Clarification Table.  
2. FSLC is a three-level input. Please see the VIL_FS and VIH_FS  
52 GNDCPU  
51 CPUT1_F  
50 CPUC1_F  
specifications in the Input/Supply/Common Output Parameters Table for correct values.  
VDD 16  
49 VDDCPU_IO  
48 NC  
SRCT1/SE1 17  
SRCC1/SE2 18  
GND 19  
VDDPLL3_IO 20  
SRCT2/SATAT 21  
SRCC2/SATAC 22  
GNDSRC 23  
47 CPUT2_ITP/SRCT8  
46 CPUC2_ITP/SRCC8  
45 VDDSRC_IO  
44 SRCT7/CR#_F  
43 SRCC7/CR#_E  
42 GNDSRC  
SRCT3/CR#_C 24  
SRCC3/CR#_D 25  
VDDSRC_IO 26  
SRCT4 27  
41 SRCT6  
40 SRCC6  
39 VDDSRC  
38 PCI_STOP#/SRCT5  
37 CPU_STOP#/SRCC5  
36 VDDSRC_IO  
35 SRCC10  
SRCC4 28  
GNDSRC 29  
SRCT9 30  
SRCC9 31  
34 SRCT10  
SRCC11/CR#_G 32  
33 SRCT11/CR#_H  
IDTTM/ICSTM 64-pin CK505 w/Fully Integrated Voltage Regulator + Integrated Series Resistor  
1121F—02/23/09  
1
1234567...28

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