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9FG1200DF-1LFT

更新时间： 2024-02-06 22:00:33

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艾迪悌 - IDT		晶体时钟发生器微控制器和处理器外围集成电路装置光电二极管 PC
页数	文件大小	规格书
23页	288K
描述
Frequency Gearing Clock for CPU, PCIe Gen1, Gen2

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9FG1200DF-1LFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SSOP
包装说明：	SSOP,	针数：	56
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.48
Is Samacsys：	N	JESD-30 代码：	R-PDSO-G56
JESD-609代码：	e3	长度：	18.43 mm
湿度敏感等级：	1	端子数量：	56
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	400 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	SSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, SHRINK PITCH	峰值回流温度（摄氏度）：	260
主时钟/晶体标称频率：	400 MHz	认证状态：	Not Qualified
座面最大高度：	2.8 mm	最大供电电压：	3.465 V
最小供电电压：	3.135 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Matte Tin (Sn) - annealed
端子形式：	GULL WING	端子节距：	0.635 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	7.5 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

9FG1200DF-1LFT 数据手册

DATASHEET

Frequency Gearing Clock for CPU, PCIe Gen1, Gen2

& FBD

ICS9FG1200D-1

Description

Features/Benefits

ICS9FG1200D-1 follows the Intel DB1200GS Differential Buffer

Specification. This buffer provides 12 output clocks for CPU Host

Bus, PCIe Gen2, or Fully Buffered DIMM applications.The outputs

are configured with two groups. Both groups (DIF 9:0) and (DIF

11:10) can be equal to or have a gear ratio to the input clock. A

differential CPU clock from a CK410B+ main clock generator,

such as the ICS932S421, drives the ICS9FG1200D-1. The

ICS9FG1200D-1 can provide outputs up to 400MHz.

•

Drives 2 channels of 4 FBDIMMs (total of 8 FBDIMMs)

Power up default is all outputs in 1:1 mode

DIF_(9:0) can be “gear-shifted” from the input CPU Host

Clock

•

DIF_(11:10) can be “gear-shifted” from the input CPU

Host Clock

•

Spread spectrum compatible

Supports output clock frequencies up to 400 MHz

8 Selectable SMBus addresses

SMBus address determines PLL or Bypass mode

Key Specifications

•

DIF output cycle-to-cycle jitter < 50ps

•

DIF output-to-output skew < 100ps across all outputs in 1:1

mode

•

56-pin SSOP/TSSOP package

RoHS compliant packaging

Functional Block Diagram

OE#

SPREAD

COMPATIBLE

1:1 PLL

STOP

DIF(11:10)

LOGIC

OE(9:0)#

SPREAD

COMPATIBLE

GEARING PLL

CLK_IN

STOP

DIF(9:0)

LOGIC

CLK_IN#

HIGH_BW#

FS_A_410

VTT_PWRGD#/PD

SMB_A0

SMB_A1

CONTROL

LOGIC

SMB_A2_PLLBYP#

SMBDAT

SMBCLK

IREF

IDT^®Frequency Gearing Clock for CPU, PCIe Gen1, Gen2 & FBD

1138C 02/08/10

12 3 4 5 6 7...23

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型号	品牌	描述	获取价格	数据表
9FG1200DG-1LF	IDT	Frequency Gearing Clock for CPU, PCIe Gen1, Gen2	获取价格
9FG1200DG-1LFT	IDT	Frequency Gearing Clock for CPU, PCIe Gen1, Gen2	获取价格
9FG1200YF-1LF-T	IDT	Processor Specific Clock Generator, 400MHz, PDSO56, 0.300 INCH, 0.635 MM PITCH, ROHS COMPL	获取价格
9FG1200YG-1LF-T	IDT	Processor Specific Clock Generator, 400MHz, PDSO56, 6.10 MM, 0.50 MM PITCH, ROHS COMPLIANT	获取价格
9FG1201HFLF	IDT	Frequency Gearing Clock for CPU, PCIe Gen1, Gen2, & FBD	获取价格
9FG1201HFLFT	IDT	Frequency Gearing Clock for CPU, PCIe Gen1, Gen2, & FBD	获取价格

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