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| 是否无铅： | 含铅 | 是否Rohs认证： | 不符合 |
| 生命周期： | Obsolete | 包装说明： | DIP, DIP14,.3 |
| Reach Compliance Code： | compliant | HTS代码： | 8542.39.00.01 |
| 风险等级： | 5.86 | JESD-30 代码： | R-PDIP-T14 |
| JESD-609代码： | e0 | 逻辑集成电路类型： | NAND GATE |
| 最大I（ol）： | 0.06 A | 端子数量： | 14 |
| 最高工作温度： | 70 °C | 最低工作温度： | |
| 封装主体材料： | PLASTIC/EPOXY | 封装代码： | DIP |
| 封装等效代码： | DIP14,.3 | 封装形状： | RECTANGULAR |
| 封装形式： | IN-LINE | 峰值回流温度（摄氏度）： | NOT SPECIFIED |
| 电源： | 5 V | 最大电源电流（ICC）： | 44 mA |
| Prop。Delay @ Nom-Sup： | 6.5 ns | 施密特触发器： | NO |
| 子类别： | Gates | 标称供电电压 (Vsup)： | 5 V |
| 表面贴装： | NO | 技术： | TTL |
| 温度等级： | COMMERCIAL | 端子面层： | Tin/Lead (Sn/Pb) |
| 端子形式： | THROUGH-HOLE | 端子节距： | 2.54 mm |
| 端子位置： | DUAL | 处于峰值回流温度下的最长时间： | NOT SPECIFIED |
| Base Number Matches： | 1 |
| 型号 | 品牌 | 描述 | 获取价格 | 数据表 |
| 74S472BN | ROCHESTER | OTP ROM |
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| 74S472N | ROCHESTER | OTP ROM |
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| 74S473 | NSC | (512 x 8) 4096-Bit TTL PROM |
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| 74S51DC | ROCHESTER | AND-OR-Invert Gate |
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| 74S51DC | TI | IC,LOGIC GATE,2 2/2-IN AND-NOR,S-TTL,DIP,14PIN,CERAMIC |
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| 74S51DCQM | FAIRCHILD | AND-OR-Invert Gate, TTL, CDIP14, |
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