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C9812DYB

更新时间： 2024-01-20 21:07:38
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 时钟发生器
页数 文件大小 规格书
18页 270K
描述
Low EMI Clock Generator for Intel 810E Chipset Systems

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C9812DYB 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：SSOP包装说明：SSOP-56
针数：56Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.88JESD-30 代码：R-PDSO-G56
JESD-609代码：e0长度：18.415 mm
湿度敏感等级：1端子数量：56
最高工作温度：70 °C最低工作温度：
最大输出时钟频率：133.3 MHz封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装等效代码：SSOP56,.4
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：220电源：2.5,3.3 V
主时钟/晶体标称频率：14.318 MHz认证状态：Not Qualified
座面最大高度：2.794 mm子类别：Clock Generators
最大压摆率：280 mA最大供电电压：3.465 V
最小供电电压：3.135 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：TIN LEAD
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.5 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：1

C9812DYB 数据手册

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APPROVED PRODUCT  
C9812  
Low EMI Clock Generator for Intel 810E Chipset Systems  
Product Features  
Frequency Table (MHz)  
SEL2  
SEL1 SEL0  
CPU  
SDRAM  
PCI  
•
•
•
•
•
•
•
•
•
•
•
•
Intel’s 810E clock solution  
X
X
0
0
1
0
0
1
1
1
0
1
0
1
X
Tristate  
Tristate  
Tristate  
3 copies of CPU Clock (CPU[0:1] and CPU_ITP)  
9 copies of SDRAM Clock (SDRAM[0:7] and DCLK)  
8 copies of PCI Clock  
2 copies of 3V66 Clock  
2 copies of APIC Clock, synchronous to PCI Clock  
1 REF Clock  
1 USB Clock (Non SSC)  
1 DOT Clock (Non SSC)  
Power Down Feature  
Spread Spectrum Support  
Test mode (see table2)  
66.6  
100  
100  
100  
33.3  
100  
33.3  
33.3  
133.3  
Table 1  
Note: The following clocks remain fixed frequencies  
except in Test Mode.  
3V66=66.6MHz, USB/DOT=48MHz, REF=14.318MHz  
and IOAPIC=33.3MHz.  
SMBUS Support for turning off unused clocks  
Pin Configuration  
Block Diagram  
56  
SEL2/REF  
VDD  
1
2
3
4
5
6
7
8
VSS  
XIN  
IOAPIC0  
IOAPIC1  
VDDI  
CPU0  
VDDC  
CPU1  
CPU2_ITP  
VSS  
55  
54  
53  
52  
36pF  
36pF  
XIN  
XOUT  
VSS  
300K  
XOUT  
VDD  
VSS  
51  
50  
49  
REF / SEL2  
1
3V660  
3V661  
VDD  
VDD  
PCI0_ICH  
PCI1  
9
48  
47  
46  
45  
44  
43  
42  
41  
VDDI  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
VSS  
IOAPIC(0:1)  
CPU(0:2)  
s2  
ioapic  
cpu  
2
3
SDRAM0  
SDRAM1  
VDDS  
SDRAM2  
SDRAM3  
VSS  
SDRAM4  
SDRAM5  
VDDS  
SDRAM6  
SDRAM7  
VSS  
Rin  
C
9
8
1
2
VDDC  
PCI2  
VSS  
PCI3  
PCI4  
VSS  
PCI5  
PCI6  
PCI7  
VDD  
VDDA  
VSSA  
VSS  
USB  
DOT  
VDD  
SEL0  
i2c-clk  
i2c-data  
SCLK  
SDATA  
VDDS  
VDD  
VDD  
40  
39  
38  
37  
36  
VDD  
SDRAM(0:7), DCLK  
3V66(0:1)  
sdram  
66m  
pci  
9
2
s1  
SEL1  
SEL0  
PD#  
s0  
pwr_dwn#  
35  
34  
33  
VDD  
VDD  
VDD  
DCLK  
VDD  
PD#  
SCLK  
SDATA  
PCI(0:7)  
DOT  
24  
25  
26  
27  
8
1
1
32  
31  
30  
PLL1  
Rin  
48  
28  
SEL1  
29  
PD#  
USB  
i2c-clk  
i2c-data  
PLL2  
Fig.1  
Cypress Semiconductor Corporation  
525 Los Coches St.  
Milpitas, CA 95035. Tel: 408-263-6300, Fax: 408-263-6571  
http://www.cypress.com  
Document#: 38-07053 Rev. **  
05/03/01  
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