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ATF1508AS-10AU100 PDF预览

ATF1508AS-10AU100

更新时间： 2024-01-25 11:31:03
品牌 Logo 应用领域
爱特美尔 - ATMEL 可编程逻辑器件输入元件异步传输模式PCATM时钟
页数 文件大小 规格书
31页 692K
描述
Highperformance EE PLD

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ATF1508AS-10AU100 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Active包装说明：TFQFP, TQFP100,.63SQ
Reach Compliance Code：compliantFactory Lead Time：12 weeks
风险等级：1.47Samacsys Confidence：3
Samacsys Status：Released2D Presentation：https://componentsearchengine.com/2D/0T/333683.1.1.png
Schematic Symbol：https://componentsearchengine.com/symbol.php?partID=333683PCB Footprint：https://componentsearchengine.com/footprint.php?partID=333683
3D View：https://componentsearchengine.com/viewer/3D.php?partID=333683Samacsys PartID：333683
Samacsys Image：https://componentsearchengine.com/Images/9/ATF1508AS-10AU100.jpgSamacsys Thumbnail Image：https://componentsearchengine.com/Thumbnails/1/ATF1508AS-10AU100.jpg
Samacsys Pin Count：100Samacsys Part Category：Integrated Circuit
Samacsys Package Category：Quad Flat PackagesSamacsys Footprint Name：ATF1508AS-10AU100
Samacsys Released Date：2019-01-19 10:42:21Is Samacsys：N
其他特性：YES最大时钟频率：125 MHz
系统内可编程：YESJESD-30 代码：S-PQFP-G100
JESD-609代码：e3JTAG BST：YES
长度：14 mm湿度敏感等级：3
专用输入次数：I/O 线路数量：80
宏单元数：128端子数量：100
最高工作温度：85 °C最低工作温度：-40 °C
组织：0 DEDICATED INPUTS, 80 I/O输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：TFQFP
封装等效代码：TQFP100,.63SQ封装形状：SQUARE
封装形式：FLATPACK, THIN PROFILE, FINE PITCH峰值回流温度（摄氏度）：260
电源：3.3/5,5 V可编程逻辑类型：EE PLD
传播延迟：10 ns认证状态：Not Qualified
座面最大高度：1.2 mm子类别：Programmable Logic Devices
最大供电电压：5.5 V最小供电电压：4.5 V
标称供电电压：5 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn) - annealed
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
宽度：14 mmBase Number Matches：1

ATF1508AS-10AU100 数据手册

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Features  
• High-density, High-performance, Electrically-erasable Complex  
Programmable Logic Device  
– 128 Macrocells  
– 5 Product Terms per Macrocell, Expandable up to 40 per Macrocell  
– 84, 100, 160 Pins  
– 7.5 ns Maximum Pin-to-pin Delay  
– Registered Operation up to 125 MHz  
– Enhanced Routing Resources  
• Flexible Logic Macrocell  
– D/T/Latch Configured Flip-flops  
High-  
performance  
EE PLD  
– Global and Individual Register Control Signals  
– Global and Individual Output Enable  
– Programmable Output Slew Rate  
– Programmable Output Open Collector Option  
– Maximum Logic Utilization by Burying a Register within a COM Output  
• Advanced Power Management Features  
– Automatic 10 µA Standby for “L” Version  
– Pin-controlled 1 mA Standby Mode  
– Programmable Pin-keeper Inputs and I/Os  
– Reduced-power Feature per Macrocell  
• Available in Commercial and Industrial Temperature Ranges  
• Available in 84-lead PLCC, 100-lead PQFP, 100-lead TQFP and 160-lead PQFP Packages  
• Advanced EE Technology  
ATF1508AS  
ATF1508ASL  
– 100% Tested  
– Completely Reprogrammable  
– 10,000 Program/Erase Cycles  
– 20-year Data Retention  
– 2000V ESD Protection  
– 200 mA Latch-up Immunity  
• JTAG Boundary-scan Testing to IEEE Std. 1149.1-1990 and 1149.1a-1993 Supported  
• Fast In-System Programmability (ISP) via JTAG  
• PCI-compliant  
• 3.3 or 5.0V I/O Pins  
• Security Fuse Feature  
• Green (Pb/Halide-free/RoHS Compliant) Package Options  
Enhanced Features  
• Improved Connectivity (Additional Feedback Routing, Alternate Input Routing)  
• Output Enable Product Terms  
• Transparent-latch Mode  
• Combinatorial Output with Registered Feedback within Any Macrocell  
• Three Global Clock Pins  
• ITD (Input Transition Detection) Circuits on Global Clocks, Inputs and I/O  
• Fast Registered Input from Product Term  
• Programmable “Pin-keeper” Option  
• VCC Power-up Reset Option  
• Pull-up Option on JTAG Pins TMS and TDI  
• Advanced Power Management Features  
– Edge-controlled Power-down “L”  
– Individual Macrocell Power Option  
– Disable ITD on Global Clocks, Inputs and I/O for “Z” Parts  
Rev. 0784P–PLD–7/05  
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