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89C51CC01C-RLTUM

更新时间： 2024-02-02 06:19:06
品牌 Logo 应用领域
爱特美尔 - ATMEL 时钟ATM异步传输模式微控制器外围集成电路
页数 文件大小 规格书
167页 1554K
描述
Microcontroller, 8-Bit, FLASH, 40MHz, CMOS, PQFP44, VQFP-44

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89C51CC01C-RLTUM 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Obsolete零件包装代码：QFP
包装说明：LQFP,针数：44
Reach Compliance Code：compliantECCN代码：3A991.A.2
HTS代码：8542.31.00.01风险等级：5.42
Is Samacsys：N具有ADC：YES
地址总线宽度：16位大小：8
最大时钟频率：40 MHzDAC 通道：NO
DMA 通道：NO外部数据总线宽度：8
JESD-30 代码：S-PQFP-G44JESD-609代码：e3
长度：10 mmI/O 线路数量：34
端子数量：44最高工作温度：85 °C
最低工作温度：-40 °CPWM 通道：YES
封装主体材料：PLASTIC/EPOXY封装代码：LQFP
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE
峰值回流温度（摄氏度）：260认证状态：Not Qualified
ROM可编程性：FLASH座面最大高度：1.6 mm
速度：40 MHz最大供电电压：5.5 V
最小供电电压：3 V标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.8 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
宽度：10 mmuPs/uCs/外围集成电路类型：MICROCONTROLLER
Base Number Matches：1

89C51CC01C-RLTUM 数据手册

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Features  
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80C51 Core Architecture  
256 Bytes of On-chip RAM  
1K Bytes of On-chip XRAM  
32K Bytes of On-chip Flash Memory  
– Data Retention: 10 Years at 85°C  
Erase/Write Cycle: 100K  
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Boot Code Section with Independent Lock Bits  
2K Bytes of On-chip Flash for Bootloader  
In-System Programming by On-Chip Boot Program (CAN, UART) and IAP Capability  
2K Bytes of On-chip EEPROM  
Enhanced 8-bit  
Microcontroller  
with CAN  
Erase/Write Cycle: 100K  
14-sources 4-level Interrupts  
Three 16-bit Timers/Counters  
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•
Full Duplex UART Compatible 80C51  
Maximum Crystal Frequency 40 MHz, in X2 Mode, 20 MHz (CPU Core, 20 MHz)  
Five Ports: 32 + 2 Digital I/O Lines  
Controller and  
Flash Memory  
Five-channel 16-bit PCA with:  
– PWM (8-bit)  
– High-speed Output  
– Timer and Edge Capture  
Double Data Pointer  
•
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•
21-bit Watchdog Timer (7 Programmable Bits)  
A 10-bit Resolution Analog to Digital Converter (ADC) with 8 Multiplexed Inputs  
Full CAN Controller:  
T89C51CC01  
AT89C51CC01  
– Fully Compliant with CAN Rev2.0A and 2.0B  
– Optimized Structure for Communication Management (Via SFR)  
– 15 Independent Message Objects:  
Each Message Object Programmable on Transmission or Reception  
Individual Tag and Mask Filters up to 29-bit Identifier/Channel  
8-byte Cyclic Data Register (FIFO)/Message Object  
16-bit Status and Control Register/Message Object  
16-bit Time-Stamping Register/Message Object  
CAN Specification 2.0 Part A or 2.0 Part B Programmable for Each Message  
Object  
Access to Message Object Control and Data Registers Via SFR  
Programmable Reception Buffer Length Up To 15 Message Objects  
Priority Management of Reception of Hits on Several Message Objects at the  
Same Time (Basic CAN Feature)  
Priority Management for Transmission  
Message Object Overrun Interrupt  
– Supports:  
Time Triggered Communication  
Autobaud and Listening Mode  
Programmable Automatic Reply Mode  
– 1-Mbit/s Maximum Transfer Rate at 8 MHz (1) Crystal Frequency in X2 Mode  
– Readable Error Counters  
– Programmable Link to On-chip Timer for Time Stamping and Network  
Synchronization  
– Independent Baud Rate Prescaler  
– Data, Remote, Error and Overload Frame Handling  
On-chip Emulation Logic (Enhanced Hook System)  
Power Saving Modes:  
•
•
– Idle Mode  
– Power-down Mode  
Rev. 4129N–CAN–03/08  
1.  
At BRP = 1 sampling point will be fixed.  
1
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