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Datasheet > 信号电路 > 锁相环或频率合成电路> AD9954YSV-REEL
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AD9954YSV-REEL

更新时间： 2024-01-13 11:18:33
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
36页 1299K
描述
IC,FREQUENCY SYNTHESIZER,CMOS,TQFP,48PIN,PLASTIC

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AD9954YSV-REEL 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFP
包装说明：HTFQFP,针数：48
Reach Compliance Code：unknown风险等级：5.14
边界扫描：NO最大时钟频率：400 MHz
JESD-30 代码：S-PQFP-G48JESD-609代码：e3
长度：7 mm低功率模式：YES
湿度敏感等级：3端子数量：48
最高工作温度：105 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：HTFQFP
封装形状：SQUARE封装形式：FLATPACK, HEAT SINK/SLUG, THIN PROFILE, FINE PITCH
峰值回流温度（摄氏度）：260认证状态：COMMERCIAL
座面最大高度：1.2 mm最大供电电压：1.89 V
最小供电电压：1.71 V标称供电电压：1.8 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：MATTE TIN
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
宽度：7 mmuPs/uCs/外围集成电路类型：DSP PERIPHERAL, NUMERIC CONTROLLED OSCILLATOR
Base Number Matches：1

AD9954YSV-REEL 数据手册

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400 MSPS 14-Bit, 1.8 V CMOS  
Direct Digital Synthesizer  
AD9954  
Support for 5 V input levels on most digital inputs  
PLL REFCLK multiplier (4× to 20×)  
Internal oscillator, can be driven by a single crystal  
Phase modulation capability  
FEATURES  
400 MSPS internal clock speed  
Integrated 14-bit DAC  
Programmable phase/amplitude dithering  
32-bit tuning word  
Multichip synchronization  
Phase noise ≤ –120 dBc/Hz @ 1 kHz offset (DAC output)  
Excellent dynamic performance  
>80 dB SFDR @ 160 MHz ( 100 kHz offset) AOUT  
Serial I/O control  
Ultrahigh speed analog comparator  
Automatic linear and nonlinear frequency sweeping  
capability  
APPLICATIONS  
Agile LO frequency synthesis  
Programmable clock generator  
FM chirp source for radar and scanning systems  
Automotive radar  
Test and measurement equipment  
Acousto-optic device drivers  
4 frequency/phase offset profiles  
1.8 V power supply  
Software and hardware controlled power-down  
48-lead TQFP/EP package  
Integrated 1024 word × 32-bit RAM  
FUNCTIONAL BLOCK DIAGRAM  
FREQUENCY  
DDS CORE  
AD9954  
ACCUMULATOR  
32  
PHASE  
M
U
X
ACCUMULATOR  
RAM  
DAC_R  
PHASE  
OFFSET  
SET  
DATA  
–1  
Z
STATIC RAM  
1024 × 32  
IOUT  
IOUT  
32  
32  
19  
14  
32  
COS(X)  
DAC  
14  
SYSTEM  
CLOCK  
14  
–1  
Z
DDS  
CLOCK  
32  
MUX  
SYNC_IN  
3
32  
10  
14  
RAM DATA  
<31:18>  
θ
OSK  
TIMING AND CONTROL LOGIC  
I/O UPDATE  
SYNC_CLK  
PWRDWNCTL  
0
M
U
X
SYNC  
CONTROL REGISTERS  
÷ 4  
COMPARATOR  
OSCILLATOR/BUFFER  
COMP_IN  
COMP_IN  
M
U
X
SYSTEM  
CLOCK  
4×–20×  
CLOCK  
MULTIPLIER  
REFCLK  
REFCLK  
COMP_OUT  
ENABLE  
CRYSTAL OUT  
PS<1:0> I/O PORT  
RESET  
Figure 1. 48-LeadTQFP/EP  
Rev. 0  
Information furnished by Analog Devices is believed to be accurate and reliable.  
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infringements of patents or other rights of third parties that may result from its use.  
Specifications subject to change without notice. No license is granted by implication  
or otherwise under any patent or patent rights of Analog Devices. Trademarks and  
registered trademarks are the property of their respective owners.  
One Technology Way, P.O. Box 9106, Norwood, MA 02062-9106, U.S.A.  
Tel: 781.329.4700  
Fax: 781.326.8703  
www.analog.com  
© 2003 Analog Devices, Inc. All rights reserved.  
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