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935048150112

更新时间： 2024-09-21 19:57:23
品牌 Logo 应用领域
恩智浦 - NXP 输入元件光电二极管逻辑集成电路
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20页 177K
描述
HCT SERIES, QUAD 2-INPUT NAND GATE, PDSO14, SOT-108-1, SO-14

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935048150112 技术参数

生命周期：Obsolete包装说明：SOP,
Reach Compliance Code：unknown风险等级：5.63
系列：HCTJESD-30 代码：R-PDSO-G14
JESD-609代码：e4长度：8.65 mm
逻辑集成电路类型：NAND GATE功能数量：4
输入次数：2端子数量：14
最高工作温度：125 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
传播延迟（tpd）：50 ns座面最大高度：1.75 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子面层：NICKEL PALLADIUM GOLD端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
宽度：3.9 mmBase Number Matches：1

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74HC132; 74HCT132  
Quad 2-input NAND Schmitt trigger  
Rev. 3 — 30 August 2012  
Product data sheet  
1. General description  
The 74HC132; 74HCT132 is a high-speed Si-gate CMOS device and is pin compatible  
with Low-power Schottky TTL (LSTTL). It is specified in compliance with JEDEC standard  
No. 7A  
The 74HC132; 74HCT132 is a quad 2-input NAND gate with Schmitt trigger inputs. This  
device features reduced input threshold levels to allow interfacing to TTL logic levels.  
Inputs also include clamp diodes that enable the use of current limiting resistors to  
interface inputs to voltages in excess of VCC. Schmitt trigger inputs transform slowly  
changing input signals into sharply defined jitter-free output signals.  
The inputs switch at different points for positive and negative-going signals. The difference  
between the positive voltage VT+ and the negative voltage VTis defined as the input  
hysteresis voltage VH.  
2. Features and benefits  
ESD protection:  
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-A exceeds 200 V  
Multiple package options  
Specified from 40 C to +85 C and from 40 C to +125 C  
3. Applications  
Wave and pulse shapers  
Astable multivibrators  
Monostable multivibrators  
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