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935020600602

更新时间： 2024-09-21 19:45:31
品牌 Logo 应用领域
恩智浦 - NXP 光电二极管
页数 文件大小 规格书
9页 146K
描述
IC PHASE LOCKED LOOP, 50 MHz, PDIP16, PLASTIC, SOT-38, DIP-16, PLL or Frequency Synthesis Circuit

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935020600602 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：DIP包装说明：PLASTIC, SOT-38, DIP-16
针数：16Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.82
模拟集成电路 - 其他类型：PHASE LOCKED LOOPJESD-30 代码：R-PDIP-T16
长度：19.025 mm功能数量：1
端子数量：16最高工作温度：125 °C
最低工作温度：-55 °C封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：245
认证状态：Not Qualified座面最大高度：4.2 mm
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：BIPOLAR温度等级：MILITARY
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：7.62 mmBase Number Matches：1

935020600602 数据手册

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Philips Semiconductors  
Product specification  
Phase-locked loop  
NE/SE564  
DESCRIPTION  
PIN CONFIGURATIONS  
The NE/SE564 is a versatile, high guaranteed frequency  
phase-locked loop designed for operation up to 50MHz. As shown  
in the Block Diagram, the NE/SE564 consists of a VCO, limiter,  
phase comparator, and post detection processor.  
D, N Packages  
1
2
3
4
5
6
7
8
16  
V+  
TTL OUTPUT  
LOOP GAIN CONTROL  
15  
14  
HYSTERESIS SET  
FEATURES  
• Operation with single 5V supply  
INPUT TO PHASE COMP  
FROM VCO  
ANALOG OUT  
13 FREQ. SET CAP  
LOOP FILTER  
LOOP FILTER  
• TTL-compatible inputs and outputs  
• Guaranteed operation to 50MHz  
• External loop gain control  
12  
11  
10  
9
FREQ. SET CAP  
VCO OUT 2  
FM/RF INPUT  
• Reduced carrier feedthrough  
BIAS FILTER  
GND  
V+  
VCO OUT TTL  
• No elaborate filtering needed in FSK applications  
• Can be used as a modulator  
TOP VIEW  
• Variable loop gain (externally controlled)  
SR01025  
Figure 1. Pin Configuration  
• Signal generators  
APPLICATIONS  
• High speed modems  
• FSK receivers and transmitters  
• Frequency Synthesizers  
• Various satcom/TV systems  
• pin configuration  
ORDERING INFORMATION  
DESCRIPTION  
TEMPERATURE RANGE  
0 to +70°C  
ORDER CODE  
NE564D  
DWG #  
SOT109-1  
SOT38-4  
SOT38-4  
16-Pin Plastic Small Outline (SO) Package  
16-Pin Plastic Dual In-Line Package (DIP)  
16-Pin Plastic Dual In-Line Package (DIP)  
0 to +70°C  
NE564N  
-55 to +125°C  
SE564N  
BLOCK DIAGRAM  
V
+
14  
4
5
1
PHASE  
COMPARATOR  
2
LIMITER  
7
6
DC  
RETRIEVER  
3
AMPLIFIER  
SCHMITT  
TRIGGER  
11  
16  
9
POST DETECTION  
PROCESSOR  
VCO  
15  
10  
8
12  
13  
SR01026  
Figure 2. Block Diagram  
1
1994 Aug 31  
853-0908 13720  
1234567...9

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型号 品牌 获取价格 描述 数据表
935020910112 NXP

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