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854S057BGILF

更新时间： 2024-11-21 01:13:47
品牌 Logo 应用领域
艾迪悌 - IDT 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
15页 532K
描述
4:1 or 2:1 LVDS Clock Multiplexer with Internal Input Termination

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854S057BGILF 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：TSSOP
包装说明：TSSOP, TSSOP20,.25针数：20
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：1.29
Samacsys Description：TSSOP 4.4 MM 0.65MM PITCH系列：854S
输入调节：STANDARDJESD-30 代码：R-PDSO-G20
JESD-609代码：e3长度：6.5 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER湿度敏感等级：1
功能数量：1反相输出次数：
端子数量：20实输出次数：1
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP20,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
电源：2.5 VProp。Delay @ Nom-Sup：0.8 ns
传播延迟（tpd）：0.8 ns认证状态：Not Qualified
座面最大高度：1.2 mm子类别：Clock Drivers
最大供电电压 (Vsup)：2.625 V最小供电电压 (Vsup)：2.375 V
标称供电电压 (Vsup)：2.5 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn) - annealed
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：4.4 mmBase Number Matches：1

854S057BGILF 数据手册

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4:1 or 2:1 LVDS Clock Multiplexer with  
Internal Input Termination  
854S057B  
Datasheet  
General Description  
Features  
The 854S057B is a 4:1 or 2:1 LVDS Clock Multiplexer which can  
operate up to 2GHz. The PCLK, nPCLK pairs can accept most  
standard differential input levels. Internal termination is provided on  
each differential input pair. The 854S057B operates using a 2.5V  
supply voltage. The fully differential architecture and low propagation  
delay make it ideal for use in high speed multiplexing applications.  
The select pins have internal pulldown resistors. Leaving one input  
unconnected (pulled to logic low by the internal resistor) will  
transform the device into a 2:1 multiplexer. The SEL1 pin is the most  
significant bit and the binary number applied to the select pins will  
select the same numbered data input (i.e., 00 selects PCLK0,  
nPCLK0).  
• High speed differential multiplexer. The device can be configured  
as either a 4:1 or 2:1 multiplexer  
• One LVDS output pair  
• Four selectable PCLK, nPCLK inputs with internal termination  
• PCLKx, nPCLKx pairs can accept the following differential  
input levels: LVPECL, LVDS, CML, SSTL  
• Maximum output frequency: >2GHz  
• Part-to-part skew: 200ps (maximum)  
• Propagation delay: 800ps (maximum)  
• Additive phase jitter, RMS: 0.065ps (typical)  
• Full 2.5V power supply  
• -40°C to 85°C ambient operating temperature  
• Available in lead-free (RoHS 6) package  
Block Diagram  
Pin Assignment  
VT0  
V
DD  
1
2
20  
19  
VDD  
PCLK3  
PCLK0  
VT0  
50  
50  
3
4
18 VT3  
17 nPCLK3  
nPCLK0  
PCLK0  
nPCLK0  
SEL1  
SEL0  
PCLK1  
5
6
7
16  
15  
14  
Q
nQ  
PCLK2  
VT1  
VT1  
nPCLK1  
GND  
8
13 VT2  
50  
50  
9
10  
12 nPCLK2  
PCLK1  
nPCLK1  
11  
GND  
0 0  
0 1  
1 0  
1 1  
854S057B  
VT2  
Q
nQ  
20-Lead TSSOP  
4.4mm x 6.5mm x 0.925mm package body  
G Package  
50  
50  
50  
PCLK2  
nPCLK2  
Top View  
VT3  
50  
PCLK3  
nPCLK3  
Pulldown  
Pulldown  
SEL1  
SEL0  
©2016 Integrated Device Technology, Inc.  
1
Revision B, February 10, 2016  
1234567...15

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854S057BGILF 替代型号

型号 品牌 替代类型 描述 数据表
854S057BGILFT IDT

完全替代

 4:1 or 2:1 LVDS Clock Multiplexer with Internal Input Termination

与854S057BGILF相关器件

型号 品牌 获取价格 描述 数据表
854S057BGILFT IDT

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 		4:1 or 2:1 LVDS Clock Multiplexer with Internal Input Termination
854S058I RENESAS

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 		8:1 Differential-to-LVDS Clock Multiplexer
854S14AKI IDT

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 		Low Skew Clock Driver, 854S Series, 4 True Output(s), 0 Inverted Output(s), 4 X 4 MM, 0.95
854S14AKILFT IDT

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 		Low Skew Clock Driver, 854S Series, 4 True Output(s), 0 Inverted Output(s), 4 X 4 MM, 0.95
854S14AKT IDT

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 		Low Skew Clock Driver, 854S Series, 4 True Output(s), 0 Inverted Output(s), 4 X 4 MM, 0.95
854S202AYI IDT

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 		Clock Driver
854S202AYI-01 IDT

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 		Differential Multiplexer, 2 Func, 12 Channel, PQFP48
854S202AYI-01T IDT

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 		Differential Multiplexer, 2 Func, 12 Channel, PQFP48
854S202AYIFT IDT

获取价格

 		Low Skew Clock Driver, 854S Series, 4 True Output(s), 0 Inverted Output(s), PQFP48, 7 X 7
854S202AYILFT IDT

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 		TQFP-48, Reel

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