79RV3041-16J

更新时间： 2024-11-11 06:32:19

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艾迪悌 - IDT		/
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描述
INTEGRATED RISController™ FOR LOW-COST SYSTEMS

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79RV3041-16J 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Active	零件包装代码：	LCC
包装说明：	QCCJ, LDCC84,1.2SQ	针数：	84
Reach Compliance Code：	not_compliant	ECCN代码：	3A991.A.2
HTS代码：	8542.31.00.01	风险等级：	5.55
其他特性：	BURST BUS; 5 PIPELINE STAGES	地址总线宽度：	32
位大小：	32	边界扫描：	NO
最大时钟频率：	33.33 MHz	外部数据总线宽度：	32
格式：	FIXED POINT	集成缓存：	YES
JESD-30 代码：	S-PQCC-J84	JESD-609代码：	e0
长度：	29.2862 mm	低功率模式：	NO
湿度敏感等级：	1	端子数量：	84
最高工作温度：	85 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	QCCJ
封装等效代码：	LDCC84,1.2SQ	封装形状：	SQUARE
封装形式：	CHIP CARRIER	峰值回流温度（摄氏度）：	225
电源：	3.3 V	认证状态：	Not Qualified
座面最大高度：	4.57 mm	速度：	16.67 MHz
子类别：	Microprocessors	最大压摆率：	130 mA
最大供电电压：	3.465 V	最小供电电压：	3.135 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	OTHER
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	J BEND
端子节距：	1.27 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	29.286 mm
uPs/uCs/外围集成电路类型：	MICROPROCESSOR, RISC	Base Number Matches：	1

79RV3041-16J 数据手册

IDT79R3041^™

INTEGRATED RISController^™FOR

LOW-COST SYSTEMS

IDT79R3041

IDT79RV3041

Integrated Device Technology, Inc.

• Double-frequency clock input

• 16.67MHz, 20MHz, 25MHz and 33MHz operation

• 20MIPS at 25MHz

• Low cost 84-pin PLCC packaging

• On-chip 4-deep write buffer eliminates memory write stalls

• On-chip 4-word read buffer supports burst or simple block

reads

FEATURES:

• Instruction set compatible with IDT79R3000A

and RISController Family MIPS RISC CPUs

• High level of integration minimizes system cost

— RISC CPU

— Multiply/divide unit

— Instruction Cache

— Data Cache

— Programmable bus interface

• On-chip DMA arbiter

• On-chip 24-bit timer

• Boot from 8-bit, 16-bit, or 32-bit wide PROMs

• Pin-andsoftware-compatiblefamilyincludesR3041,R3051,

R3052^™, and R3081^™

• Complete software support

— Optimizing compilers

— Real-time operating systems

— Monitors/debuggers

— Floating Point emulation software

— Page Description Languages

— Programmable port width support

• On-chip instruction and data caches

— 2KB of Instruction Cache

— 512B of Data Cache

• Flexible bus interface allows simple, low-cost designs

— Superset pin-compatible with RISController

— Adds programmable port width interface

(8-, 16-, and 32-bit memory sub-regions)

— Adds programmable bus interface timing support

(Extended address hold, Bus turn around time,

Read/write masks)

SBrCond(3:2)

Clock

Generator

Unit

Master Pipeline Control

ClkIn

System Control

Coprocessor

Integer

CPU Core

Int(5:3), SInt(2:0)

Exception/Control

Registers

General Registers

(32 x 32)

ALU

Shifter

Bus Interface

Registers

PortSize

Counter

Registers

Mult/Div Unit

Address Adder

PC Control

Virtual Address

Physical Address Bus

Instruction

Cache

2kB

Data

Cache

512B

Data Bus

R3051 Superset

Bus Interface Unit

4-deep

Write

Buffer

4-deep

DMA

BIU

Control

Read

Arbiter

Buffer

Data

Unpack

Unit

Data

Pack

Unit

Timing/ Interface

Control

Address/

Data

DMA Rd/Wr SysClk

2905 drw 01

Ctrl

Figure 1. R3041 Block Diagram

RISController, R3041, R3051, R3052, R3081, ORION, IDT/sim, and IDT/kit are trademarks, and the IDT logo is a registered trademark of Integrated Device Technology, Inc.

COMMERCIAL TEMPERATURE RANGE

December 2008

DSC-2905/5

12 3 4 5 6 7...34

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