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74VHCT573AMTR

更新时间： 2024-11-20 22:56:27

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意法半导体 - STMICROELECTRONICS		总线驱动器总线收发器逻辑集成电路光电二极管输出元件
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OCTAL D-TYPE LATCH WITH 3 STATE OUTPUT NON INVERTING

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74VHCT573AMTR 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	SOP, SOP20,.4
针数：	20	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.17
Is Samacsys：	N	系列：	AHCT/VHCT
JESD-30 代码：	R-PDSO-G20	JESD-609代码：	e4
长度：	12.8 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	BUS DRIVER	最大I（ol）：	0.008 A
位数：	8	功能数量：	1
端口数量：	2	端子数量：	20
最高工作温度：	125 °C	最低工作温度：	-55 °C
输出特性：	3-STATE	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP20,.4	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	包装方法：	TAPE AND REEL
电源：	5 V	Prop。Delay @ Nom-Sup：	10 ns
传播延迟（tpd）：	10 ns	认证状态：	Not Qualified
座面最大高度：	2.65 mm	子类别：	FF/Latches
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	MILITARY
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
宽度：	7.5 mm	Base Number Matches：	1

74VHCT573AMTR 数据手册

74VHCT573A

OCTAL D-TYPE LATCH

WITH 3 STATE OUTPUT NON INVERTING

■

HIGH SPEED:t_PD=5.4ns (TYP.) atV_CC= 5V

LOW POWER DISSIPATION:

I_CC=4 µA (MAX.) at T_A=25 ^oC

COMPATIBLEWITH TTL OUTPUTS:

V_IH=2V (MIN), V_IL= 0.8V(MAX)

POWERDOWN PROTECTIONON INPUTS&

OUTPUTS

SYMMETRICAL OUTPUT IMPEDANCE:

|I_OH| = I_OL= 8 mA (MIN)

BALANCEDPROPAGATIONDELAYS:

t_PLHt_PHL

■

SOP

TSSOP

ORDER CODES

TUBE

PACKAGE

SOP

T & R

74VHCT573AM 74VHCT573AMTR

74VHCT573ATTR

TSSOP

While the LE input is held at a high level, the Q

outputswill follow the data inputs precisely.

When the LE is taken low, the Q outputs will be

latched precisely at the logic level of D input data.

OPERATING VOLTAGERANGE:

V_CC(OPR)= 4.5V to 5.5V

PIN AND FUNCTION COMPATIBLEWITH

74 SERIES573

While the (OE) input is low, the 8 outputs will be

in a normal logic state (high or low logic level)

and while high level the outputs will be in a high

impedance state.

■

IMPROVED LATCH-UP IMMUNITY

LOWNOISE:V_OLP= 0.9V(Max.)

DESCRIPTION

Power down protection is provided on all inputs

and outputs and 0 to 7V can be accepted on

inputs with no regard to the supply voltage. This

device can be used to interface 5V to 3V.

All inputs and outputs are equipped with

protection circuits against static discharge, giving

them 2KV ESD immunity and transient excess

voltage.

The 74VHCT573A is an advanced high-speed

CMOS OCTAL D-TYPE LATCH with 3 STATE

OUTPUT NON INVERTING fabricated with

sub-micron silicon gate and double-layer metal

wiring C²MOS technology.

This 8 bit D-Type latch is controlled by a latch

enable input (LE) and an output enable input

(OE).

PIN CONNECTION AND IEC LOGIC SYMBOLS

1/10

February 2000

12 3 4 5 6 7...10

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