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Datasheet > 逻辑 > 总线驱动器/收发器> 74VHCT373AMTC
74VHCT373AMTC PDF预览

74VHCT373AMTC

更新时间： 2024-11-05 22:56:27
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 总线驱动器总线收发器锁存器逻辑集成电路光电二极管
页数 文件大小 规格书
8页 108K
描述
Octal D-Type Latch with 3-STATE Outputs

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74VHCT373AMTC 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：TSSOP包装说明：4.40 MM, LEAD FREE, MO-153AC, TSSOP-20
针数：20Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.25
Is Samacsys：N系列：AHCT/VHCT
JESD-30 代码：R-PDSO-G20JESD-609代码：e3
长度：6.5 mm负载电容（CL）：50 pF
逻辑集成电路类型：BUS DRIVER最大I（ol）：0.008 A
湿度敏感等级：1位数：8
功能数量：1端口数量：2
端子数量：20最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP20,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：RAIL峰值回流温度（摄氏度）：260
电源：5 VProp。Delay @ Nom-Sup：10.5 ns
传播延迟（tpd）：14.5 ns认证状态：Not Qualified
座面最大高度：1.2 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：4.4 mm
Base Number Matches：1

74VHCT373AMTC 数据手册

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July 1997  
Revised April 2005  
74VHCT373A  
Octal D-Type Latch with 3-STATE Outputs  
General Description  
Features  
The VHCT373A is an advanced high speed CMOS octal D-  
type latch with 3-STATE output fabricated with silicon gate  
CMOS technology. It achieves the high speed operation  
similar to equivalent Bipolar Schottky TTL while maintain-  
ing the CMOS low power dissipation. This 8-bit D-type  
latch is controlled by a latch enable input (LE) and an out-  
put enable input (OE). The latches appear transparent to  
data when latch enable (LE) is HIGH. When LE is LOW, the  
data that meets the setup time is latched. When the OE  
input is HIGH, the eight outputs are in a high impedance  
state.  
■ High speed: tPD 7.7 ns (typ) at TA 25 C  
■ High Noise Immunity: VIH 2.0V, VIL 0.8V  
■ Power Down Protection is provided on all inputs and  
outputs  
■ Low Power Dissipation:  
ICC  
4 A (max) @ TA 25 C  
■ Pin and Function Compatible with 74HCT373  
Protection circuits ensure that 0V to 7V can be applied to  
the input and output (Note 1) pins without regard to the  
supply voltage. This device can be used to interface 3V to  
5V systems and two supply systems such as battery back  
up. This circuit prevents device destruction due to mis-  
matched supply and input voltages.  
Note 1: Outputs in OFF-State.  
Ordering Code:  
Order Number  
74VHCT373AM  
74VHCT373ASJ  
74VHCT373AMTC  
74VHCT373AN  
Package Number  
M20B  
Package Description  
20-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-013, 0.300" Wide  
Pb-Free 20-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide  
20-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 4.4mm Wide  
20-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300" Wide  
M20D  
MTC20  
N20A  
Surface mount packages are also available on Tape and Reel. Specify by appending the suffix letter “X” to the ordering code  
Pb-Free package per JEDEC J-STD-020B.  
Logic Symbol  
Connection Diagram  
IEEE/IEC  
© 2005 Fairchild Semiconductor Corporation  
DS500027  
www.fairchildsemi.com  
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74VHCT373AMTC 替代型号

型号 品牌 替代类型 描述 数据表
74AHCT373PW,118 NXP

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