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74VHC132MTR

更新时间： 2024-01-13 18:12:12
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 输入元件
页数 文件大小 规格书
11页 239K
描述
QUAD 2-INPUT SCHMITT NAND GATE

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74VHC132MTR 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP-14针数：14
Reach Compliance Code：compliantHTS代码：8542.39.00.01
Factory Lead Time：16 weeks风险等级：5.22
Is Samacsys：N系列：AHC/VHC
JESD-30 代码：R-PDSO-G14JESD-609代码：e4
长度：5 mm负载电容（CL）：50 pF
逻辑集成电路类型：NAND GATE最大I（ol）：0.008 A
功能数量：4输入次数：2
端子数量：14最高工作温度：125 °C
最低工作温度：-55 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP14,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：NOT SPECIFIED
电源：2/5.5 VProp。Delay @ Nom-Sup：11 ns
传播延迟（tpd）：17.5 ns认证状态：Not Qualified
施密特触发器：YES座面最大高度：1.2 mm
子类别：Gates最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：4.4 mmBase Number Matches：1

74VHC132MTR 数据手册

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74VHC132  
QUAD 2-INPUT SCHMITT NAND GATE  
■
■
HIGH SPEED: t = 3.9 ns (TYP.) at V = 5V  
PD CC  
LOW POWER DISSIPATION:  
I
= 2 µA (MAX.) at T =25°C  
CC  
A
■
TYPICAL HYSTERESIS:  
V = 1V at V = 4.5V  
h
CC  
■
■
POWER DOWN PROTECTION ON INPUTS  
SYMMETRICAL OUTPUT IMPEDANCE:  
SOP  
TSSOP  
|I | = I = 8 mA (MIN)  
OH  
OL  
■
■
■
BALANCED PROPAGATION DELAYS:  
t
t
PLH  
PHL  
Table 1: Order Codes  
PACKAGE  
OPERATING VOLTAGE RANGE:  
(OPR) = 2V to 5.5V  
V
T & R  
CC  
PIN AND FUNCTION COMPATIBLE WITH  
74 SERIES 132  
IMPROVED LATCH-UP IMMUNITY  
SOP  
74VHC132MTR  
74VHC132TTR  
TSSOP  
■
■
LOW NOISE: V  
= 0.8V (MAX.)  
OLP  
Pin configuration and function are the same as  
those of the 74VHC00 but the 74VHC132 has  
hysteresis.  
This together with its schmitt trigger function  
allows it to be used on line receivers with slow  
rise/fall input signals.  
DESCRIPTION  
The 74VHC132 is an advanced high-speed  
CMOS QUAD 2-INPUT SCHMITT NAND GATE  
fabricated with sub-micron silicon gate and  
2
double-layer metal wiring C MOS technology.  
All inputs and outputs are equipped with  
protection circuits against static discharge, giving  
them 2KV ESD immunity and transient excess  
voltage.  
Power down protection is provided on all inputs  
and 0 to 7V can be accepted on inputs with no  
regard to the supply voltage. This device can be  
used to interface 5V to 3V.  
Figure 1: Pin Connection And IEC Logic Symbols  
Rev. 4  
1/11  
November 2004  
1234567...11

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