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74VHC00M PDF预览

74VHC00M

更新时间： 2024-11-04 22:16:59
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 栅极触发器逻辑集成电路光电二极管输入元件
页数 文件大小 规格书
7页 56K
描述
QUAD 2-INPUT NAND GATE

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74VHC00M 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOP-14
针数：14Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.1
Is Samacsys：N系列：AHC/VHC
JESD-30 代码：R-PDSO-G14JESD-609代码：e0
长度：8.65 mm负载电容（CL）：50 pF
逻辑集成电路类型：NAND GATE最大I（ol）：0.008 A
功能数量：4输入次数：2
端子数量：14最高工作温度：125 °C
最低工作温度：-55 °C封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP14,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
包装方法：TUBE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：2/5.5 VProp。Delay @ Nom-Sup：8.5 ns
传播延迟（tpd）：13 ns认证状态：Not Qualified
施密特触发器：NO座面最大高度：1.75 mm
子类别：Gates最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：3.9 mmBase Number Matches：1

74VHC00M 数据手册

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74VHC00  
QUAD 2-INPUT NAND GATE  
PRELIMINARY DATA  
■
■
HIGH SPEED:tPD =3.7ns (TYP.) atVCC = 5V  
LOW POWER DISSIPATION:  
ICC =2 µA (MAX.) at TA =25 oC  
HIGH NOISEIMMUNITY:  
■
VNIH = VNIL =28% VCC (MIN.)  
M
T
■
■
POWERDOWN PROTECTIONON INPUTS  
SYMMETRICAL OUTPUT IMPEDANCE:  
|IOH| = IOL = 8 mA (MIN)  
BALANCEDPROPAGATIONDELAYS:  
tPLH tPHL  
(Micro Package)  
(TSSOPPackage)  
ORDER CODES :  
74VHC00M  
■
■
■
74VHC00T  
including buffer output, which provide high noise  
immunity and stable output.  
Power down protection is provided on all inputs  
and 0 to 7V can be accepted on inputs with no  
regard to the supply voltage. This device can be  
used to interface5V to 3V.  
OPERATING VOLTAGERANGE:  
VCC (OPR)= 2V to 5.5V  
PIN AND FUNCTION COMPATIBLEWITH  
74 SERIES00  
IMPROVED LATCH-UP IMMUNITY  
LOWNOISE:VOLP = 0.8V(Max.)  
■
■
All inputs and outputs are equipped with  
protection circuits against static discharge, giving  
them 2kV ESD immunity and transient excess  
voltage.  
DESCRIPTION  
The 74VHC00 is an advanced high-speed CMOS  
QUAD 2-INPUT NAND GATE fabricated with  
sub-micron silicon gate and double-layer metal  
wiring C2MOS technology.  
The internal circuit is composed of 3 stages  
PIN CONNECTION AND IEC LOGIC SYMBOLS  
1/7  
June 1999  
1234567

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型号 品牌 获取价格 描述 数据表
74VHC00M_08 FAIRCHILD

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