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74LX1G08CTR PDF预览

74LX1G08CTR

更新时间： 2024-11-10 22:12:59
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 触发器逻辑集成电路光电二极管输入元件栅
页数 文件大小 规格书
10页 203K
描述
LOW VOLTAGE CMOS SINGLE 2-INPUT AND GATE WITH 5V TOLERANT INPUT

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74LX1G08CTR 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SC-70
包装说明：TSSOP, TSSOP5/6,.08针数：5
Reach Compliance Code：compliantECCN代码：EAR99
风险等级：7.24系列：TTL/H/L
JESD-30 代码：R-PDSO-G5JESD-609代码：e3
长度：2 mm负载电容（CL）：50 pF
逻辑集成电路类型：AND GATE最大I（ol）：0.024 A
功能数量：1输入次数：2
端子数量：5最高工作温度：125 °C
最低工作温度：-55 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP5/6,.08
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：260
电源：3.3 VProp。Delay @ Nom-Sup：4.2 ns
传播延迟（tpd）：12 ns认证状态：Not Qualified
施密特触发器：NO座面最大高度：1.1 mm
子类别：Gates最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：1.65 V标称供电电压 (Vsup)：1.8 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：1.25 mmBase Number Matches：1

74LX1G08CTR 数据手册

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74LX1G08  
LOW VOLTAGE CMOS SINGLE 2-INPUT AND GATE  
WITH 5V TOLERANT INPUT  
■
■
■
5V TOLERANT INPUTS  
HIGH SPEED: t = 4.5ns (MAX.) at V = 3V  
PD  
CC  
LOW POWER DISSIPATION:  
I
= 1µA (MAX.) at T = 25°C  
CC  
A
■
■
■
■
POWER DOWN PROTECTION ON INPUTS  
AND OUTPUTS  
SOT23-5  
SC70-5  
SYMMETRICAL OUTPUT IMPEDANCE:  
|I | = I = 24mA (MIN) at V = 3V  
OH  
OL  
CC  
BALANCED PROPAGATION DELAYS:  
ORDER CODES  
t
t
PLH  
PHL  
PACKAGE  
T & R  
OPERATING VOLTAGE RANGE:  
(OPR) = 1.65V to 5.5V  
V
SOT23-5L  
74LX1G08STR  
74LX1G08CTR  
CC  
(1.2V Data Retention)  
SOT323-5L  
■
IMPROVED LATCH-UP IMMUNITY  
output, which provide high noise immunity and  
stable output.  
DESCRIPTION  
The 74LX1G08 is a low voltage CMOS SINGLE  
2-INPUT AND GATE fabricated with sub-micron  
silicon gate and double-layer metal wiring C MOS  
tecnology.  
It is ideal for 1.65 to 5.5 V  
Power down protection is provided on input and  
output and 0 to 7V can be accepted on inputs with  
no regard to the supply voltage. It can be  
interfaced to 5V signal environment for inputs in  
mixed 3.3/5V system.  
2
operations and low  
CC  
power and low noise applications. The internal  
circuit is composed of 3 stages including buffer  
All inputs and outputs are equipped with  
protection circuits against static discharge.  
PIN CONNECTION AND IEC LOGIC SYMBOLS  
October 2002  
1/10  
1234567...10

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