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74LVX273MX_NL

更新时间： 2024-11-27 13:04:59
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 触发器
页数 文件大小 规格书
7页 95K
描述
D Flip-Flop, LV/LV-A/LVX/H Series, 1-Func, Positive Edge Triggered, 8-Bit, True Output, CMOS, PDSO20, 0.300 INCH, MS-013, SOIC-20

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74LVX273MX_NL 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOP, SOP20,.4
针数：20Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.11
系列：LV/LV-A/LVX/HJESD-30 代码：R-PDSO-G20
JESD-609代码：e3长度：12.8 mm
负载电容（CL）：50 pF逻辑集成电路类型：D FLIP-FLOP
最大频率@ Nom-Sup：50000000 Hz最大I（ol）：0.004 A
湿度敏感等级：1位数：8
功能数量：1端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP20,.4
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：260
电源：3.3 VProp。Delay @ Nom-Sup：16.5 ns
传播延迟（tpd）：24 ns认证状态：Not Qualified
座面最大高度：2.65 mm子类别：FF/Latches
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：2.7 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：POSITIVE EDGE
宽度：7.5 mm最小 fmax：80 MHz
Base Number Matches：1

74LVX273MX_NL 数据手册

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June 1993  
Revised April 2005  
74LVX273  
Low Voltage Octal D-Type Flip-Flop  
General Description  
Features  
The LVX273 has eight edge-triggered D-type flip-flops with  
individual D inputs and Q outputs. The common buffered  
Clock (CP) and Master Reset (MR) input load and reset  
(clear) all flip-flops simultaneously.  
■ Input voltage translation from 5V to 3V  
■ Ideal for low power/low noise 3.3V applications  
■ Guaranteed simultaneous switching noise level and  
dynamic threshold performance  
The register is fully edge-triggered. The state of each D  
input, one setup time before the LOW-to-HIGH clock transi-  
tion, is transferred to the corresponding flip-flop’s Q output.  
All outputs will be forced LOW independently of Clock or  
Data inputs by a LOW voltage level on the MR input. The  
device is useful for applications where the true output only  
is required and the Clock and Master Reset are common to  
all storage elements. The inputs tolerate up to 7V allowing  
interface of 5V systems to 3V systems.  
Ordering Code:  
Order Number Package Number  
Package Description  
74LVX273M  
M20B  
M20D  
20-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-013, 0.300" Wide  
Pb-Free 20-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide  
20-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 4.4mm Wide  
74LVX273SJ  
74LVX273MTC  
MTC20  
Devices also available in Tape and Reel. Specify by appending letter suffix “X” to the ordering code.  
Pb-Free package per JEDEC J-STD-020B.  
Logic Symbols  
Connection Diagram  
IEEE/IEC  
Truth Table  
Operating Mode  
Inputs  
Outputs  
Qn  
Pin Descriptions  
Dn  
MR  
L
CP  
Pin Names  
Description  
Reset (Clear)  
Load '1'  
X
X
H
L
L
H
L
D0–D7  
MR  
Data Inputs  
Master Reset  
H
Load '0'  
H
CP  
Clock Pulse Input  
Data Outputs  
H
L
HIGH Voltage Level  
LOW Voltage Level  
X
Immaterial  
LOW-to-HIGH Transition  
Q0–Q7  
© 2005 Fairchild Semiconductor Corporation  
DS011614  
www.fairchildsemi.com  
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与74LVX273MX_NL相关器件

型号 品牌 获取价格 描述 数据表
74LVX273SJ FAIRCHILD

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 		Low Voltage Octal D-Type Flip-Flop
74LVX273SJ TI

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 		LV/LV-A/LVX/H SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO20, EIAJ TYPE2
74LVX273SJX FAIRCHILD

获取价格

 		D Flip-Flop, LV/LV-A/LVX/H Series, 1-Func, Positive Edge Triggered, 8-Bit, True Output, CM
74LVX273T ETC

获取价格

 		Octal D-Type Flip-Flop
74LVX273TTR STMICROELECTRONICS

获取价格

 		LOW VOLTAGE CMOS OCTAL D-TYPE FLIP-FLOP WITH CLEAR (5V TOLERANT INPUTS)
74LVX27M STMICROELECTRONICS

获取价格

 		LOW VOLTAGE CMOS TRIPLE 3 INPUT NOR GATE WITH 5V TOLERANT INPUTS
74LVX27MTR STMICROELECTRONICS

获取价格

 		LOW VOLTAGE CMOS TRIPLE 3 INPUT NOR GATE WITH 5V TOLERANT INPUTS
74LVX27T ETC

获取价格

 		Triple 3-input NOR Gate
74LVX27TTR STMICROELECTRONICS

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 		LOW VOLTAGE CMOS TRIPLE 3 INPUT NOR GATE WITH 5V TOLERANT INPUTS
74LVX32 STMICROELECTRONICS

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 		LOW VOLTAGE CMOS QUAD 2-INPUT OR GATE WITH 5V TOLERANT INPUTS

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