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74LVX00MX_NL

更新时间： 2024-11-22 22:30:55

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飞兆/仙童 - FAIRCHILD		栅
页数	文件大小	规格书
6页	87K
描述
Low Voltage Quad 2-Input NAND Gate

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74LVX00MX_NL 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	SOP, SOP14,.25
针数：	14	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.37
系列：	LV/LV-A/LVX/H	JESD-30 代码：	R-PDSO-G14
JESD-609代码：	e3	长度：	8.6235 mm
负载电容（CL）：	50 pF	逻辑集成电路类型：	NAND GATE
最大I（ol）：	0.004 A	湿度敏感等级：	1
功能数量：	4	输入次数：	2
端子数量：	14	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装等效代码：	SOP14,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
包装方法：	TAPE AND REEL	峰值回流温度（摄氏度）：	260
电源：	3.3 V	Prop。Delay @ Nom-Sup：	11 ns
传播延迟（tpd）：	16 ns	认证状态：	Not Qualified
施密特触发器：	NO	座面最大高度：	1.753 mm
子类别：	Gates	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	2.7 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Matte Tin (Sn)
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	3.9 mm	Base Number Matches：	1

74LVX00MX_NL 数据手册

February 1993

Revised February 2005

74LVX00

Low Voltage Quad 2-Input NAND Gate

General Description

The LVX00 contains four 2-input NAND gates. The inputs

tolerate voltages up to 7V allowing the interface of 5V sys-

tems to 3V systems.

Features

■ Input voltage level translation from 5V to 3V

■ Ideal for low power/low noise 3.3V applications

■ Guaranteed simultaneous switching noise level and

dynamic threshold performance

Ordering Code:

Package

Order Number

Package Description

Number

74LVX00M

M14A 14-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-012, 0.150" Narrow

M14A Pb-Free 14-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-012, 0.150" Narrow

74LVX00MX_NL

(Note 1)

74LVX00SJ

M14D Pb-Free 14-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide

74LVX00MTC

MTC14 14-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 4.4mm Wide

74LVX00MTCX_NL MTC14 Pb-Free 14-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 4.4mm Wide

(Note 1)

Devices also available in Tape and Reel. Specify by appending suffix letter “X” to the ordering code.

Pb-Free package per JEDEC J-STD-020B.

Note 1: “_NL” indicates Pb-Free package (per JEDEC J-STD-020B). Device available in Tape and Reel only.

Logic Symbol

Connection Diagram

IEEE/IEC

Pin Descriptions

Pin Names

A_n, B_n

O_n

Description

Inputs

Outputs

DS011551

www.fairchildsemi.com

12 3 4 5 6

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型号	品牌	获取价格	描述	数据表
74LVX00SJ	FAIRCHILD	获取价格	Low Voltage Quad 2-Input NAND Gate
74LVX00SJX	ETC	获取价格	Quad 2-input NAND Gate
74LVX00T	ETC	获取价格	Quad 2-input NAND Gate
74LVX00TTR	STMICROELECTRONICS	获取价格	LOW VOLTAGE CMOS QUAD 2-INPUT NAND GATE WITH 5V TOLERANT INPUTS
74LVX02	STMICROELECTRONICS	获取价格	LOW VOLTAGE CMOS QUAD 2-INPUT NOR GATE WITH 5V TOLERANT INPUTS
74LVX02	FAIRCHILD	获取价格	Low Voltage Quad 2-Input NOR Gate
74LVX02M	STMICROELECTRONICS	获取价格	LOW VOLTAGE CMOS QUAD 2-INPUT NOR GATE WITH 5V TOLERANT INPUTS
74LVX02M	FAIRCHILD	获取价格	Low Voltage Quad 2-Input NOR Gate
74LVX02M	ONSEMI	获取价格	低压四路2输入"或非"门
74LVX02MSCX	FAIRCHILD	获取价格	NOR Gate, LV/LV-A/LVX/H Series, 4-Func, 2-Input, CMOS, PDSO14, EIAJ TYPE1, PLASTIC, SSOP-1

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