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Datasheet > 逻辑 > 总线驱动器/收发器> 74LVTH16835MEA
74LVTH16835MEA PDF预览

74LVTH16835MEA

更新时间： 2024-09-13 22:56:23
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 总线驱动器总线收发器逻辑集成电路光电二极管信息通信管理
页数 文件大小 规格书
7页 65K
描述
Low Voltage 18-Bit Universal Bus Driver with 3-STATE Outputs (Preliminary)

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74LVTH16835MEA 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：SSOP包装说明：SSOP, SSOP56,.4
针数：56Reach Compliance Code：compliant
风险等级：5.57Is Samacsys：N
控制类型：ENABLE LOW系列：LVT
JESD-30 代码：R-PDSO-G56JESD-609代码：e3
长度：18.415 mm逻辑集成电路类型：BUS DRIVER
最大I（ol）：0.064 A湿度敏感等级：1
位数：18功能数量：1
端口数量：2端子数量：56
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装等效代码：SSOP56,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH峰值回流温度（摄氏度）：260
电源：3.3 V最大电源电流（ICC）：5 mA
Prop。Delay @ Nom-Sup：5.1 ns传播延迟（tpd）：6.1 ns
认证状态：Not Qualified座面最大高度：2.74 mm
子类别：Bus Driver/Transceivers最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：2.7 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：BICMOS
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.5 mmBase Number Matches：1

74LVTH16835MEA 数据手册

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Preliminary  
May 2000  
Revised May 2000  
74LVTH16835  
Low Voltage 18-Bit Universal Bus Driver  
with 3-STATE Outputs (Preliminary)  
General Description  
Features  
■ Input and output interface capability to systems at  
The LVTH16835 consists of 18-bit universal bus drivers  
which combine D-type latches and D-type flip-flops to allow  
data flow in transparent, latched, or clocked modes. Data  
flow from A to Y is controlled by the output-enable (OE)  
input. This device operates in the transparent mode when  
the latch-enable (LE) input is HIGH. The A data is latched if  
the clock (CLK) input is held at a HIGH or LOW logic level.  
If LE is LOW, the A-bus data is stored in the latch/flip-flop  
on the LOW-to-HIGH transition of the CLK. When OE is  
HIGH, the outputs are in the high-impedance state.  
5V VCC  
■ Bushold data inputs eliminate the need for external  
pull-up resistors to hold unused inputs  
■ Live insertion/extraction permitted  
■ Power Up/Down high impedance provides glitch-free  
bus loading  
■ Outputs source/sink −32 mA/+64 mA  
■ Latch-up performance exceeds 500 mA  
The LVTH16835 data inputs include bushold, eliminating  
the need for external pull-up resistors to hold unused  
inputs.  
The bus driver is designed for low voltage (3.3V) VCC appli-  
cations, but with the capability to provide a TTL interface to  
a 5V environment. The LVTH16835 is fabricated with an  
advanced BiCMOS technology to achieve high speed oper-  
ation similar to 5V ABT while maintaining low power dissi-  
pation.  
Ordering Code:  
Order Number  
74LVTH16835MEA  
74LVTH16835MTD  
Package Number  
MS56A  
Package Description  
56-Lead Shrink Small Outline Package (SSOP), JEDEC MO-118, 0.300 Wide  
56-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 6.1mm Wide  
MTD56  
Devices also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.  
© 2000 Fairchild Semiconductor Corporation  
DS500102  
www.fairchildsemi.com  
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型号 品牌 获取价格 描述 数据表
74LVTH16835MEAX ETC

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