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74LVT16652ADGG-T

更新时间： 2024-11-10 09:28:11

品牌	Logo	应用领域
恩智浦 - NXP		信息通信管理光电二极管输出元件逻辑集成电路
页数	文件大小	规格书
21页	115K
描述
IC LVT SERIES, DUAL 8-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, PDSO56, 6.10 MM, PLASTIC, MO-153, SOT-364-1, TSSOP-56, Bus Driver/Transceiver

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74LVT16652ADGG-T 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Transferred	零件包装代码：	TSSOP
包装说明：	6.10 MM, PLASTIC, MO-153, SOT-364-1, TSSOP-56	针数：	56
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.4	其他特性：	WITH INDEPENDENT OUTPUT ENABLE FOR EACH DIRECTION
系列：	LVT	JESD-30 代码：	R-PDSO-G56
JESD-609代码：	e4	长度：	14 mm
逻辑集成电路类型：	REGISTERED BUS TRANSCEIVER	湿度敏感等级：	1
位数：	8	功能数量：	2
端口数量：	2	端子数量：	56
最高工作温度：	85 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	传播延迟（tpd）：	4.7 ns
认证状态：	Not Qualified	座面最大高度：	1.2 mm
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	2.7 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	BICMOS	温度等级：	INDUSTRIAL
端子面层：	NICKEL PALLADIUM GOLD	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	6.1 mm

74LVT16652ADGG-T 数据手册

74LVT16652A

3.3 V 16-bit bus transceiver/register; 3-state

Rev. 03 — 12 January 2005

Product data sheet

1. General description

The 74LVT16652A is a high-performance BiCMOS product designed for V_CCoperation at

3.3 V. The device can be used as two 8-bit transceivers or one 16-bit transceiver.

Complimentary output enable (OEAB and OEBA) inputs are provided to control the

transceiver functions. Select control (SAB and SBA) inputs are provided to select whether

real-time or stored data is transferred. A LOW input level selects real-time data, and a

HIGH input level selects stored data. The circuitry used for select control eliminates the

typical decoding glitch that occurs in a multiplexer during the transition between stored

and real-time data.

Data on the A or B bus, or both, can be stored in the internal ﬂip-ﬂops by LOW-to-HIGH

transitions at the appropriate clock (CPAB or CPBA) inputs regardless of the levels on the

select control or output enable inputs. When SAB and SBA are in real-time transfer mode,

it is possible to store data without using the internal D-type ﬂip-ﬂops by simultaneously

enabling OEAB and OEBA. In this conﬁguration, each output reinforces its input. Thus,

when all other data sources to the two sets of bus lines are at high- impedance, each set

of bus lines remains at its last level conﬁguration.

2. Features

■ 16-bit bus interface

■ 3-state buffers

■ Output capability: +64 mA and −32 mA

■ TTL input and output switching levels

■ Input and output interface capability to systems at 5 V supply

■ Bus-hold data inputs eliminate the need for external pull-up resistors to hold unused

inputs

■ Live insertion and extraction permitted

■ Power-up reset

■ Power-up 3-state

■ No bus current loading when output is tied to 5 V bus

■ Latch-up protection exceeds 500 mA per JESD78

■ ESD protection:

◆ MIL STD 883 method 3015: exceeds 2000 V

◆ Machine model: exceeds 200 V

12 3 4 5 6 7...21

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型号	品牌	获取价格	描述	数据表
74LVT16652ADL	NXP	获取价格	3.3V LVT 16-bit bus transceiver/ register 3-State
74LVT16652ADL,112	NXP	获取价格	74LVT16652A - 3.3 V 16-bit bus transceiver/register; 3-state SSOP 56-Pin
74LVT16652ADL,118	NXP	获取价格	74LVT16652A - 3.3 V 16-bit bus transceiver/register; 3-state SSOP 56-Pin
74LVT16652ADL,512	NXP	获取价格	74LVT16652A - 3.3 V 16-bit bus transceiver/register; 3-state SSOP 56-Pin
74LVT16652ADL,518	NXP	获取价格	74LVT16652A - 3.3 V 16-bit bus transceiver/register; 3-state SSOP 56-Pin
74LVT16652ADL-T	ETC	获取价格	Dual 8-bit Bus Transceiver
74LVT16652MEA	NSC	获取价格	3.3V ABT 16-Bit Transceiver/Register with TRI-STATE Outputs
74LVT16652MEA	TI	获取价格	LVT SERIES, DUAL 8-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, PDSO56, 0.300 INCH, PLASTIC, S
74LVT16652MEAX	NSC	获取价格	3.3V ABT 16-Bit Transceiver/Register with TRI-STATE Outputs
74LVT16652MEAX	TI	获取价格	LVT SERIES, DUAL 8-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, PDSO56, 0.300 INCH, PLASTIC, S

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