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74LVQ161MTR PDF预览

74LVQ161MTR

更新时间： 2024-11-20 00:00:47
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 计数器触发器逻辑集成电路光电二极管
页数 文件大小 规格书
15页 370K
描述
SYNCHRONOUS PRESETTABLE 4-BIT COUNTER

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74LVQ161MTR 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOP-16
针数：16Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.84
Is Samacsys：N计数方向：UP
系列：LVQJESD-30 代码：R-PDSO-G16
JESD-609代码：e4长度：9.9 mm
负载电容（CL）：50 pF负载/预设输入：YES
逻辑集成电路类型：BINARY COUNTER最大频率@ Nom-Sup：80000000 Hz
最大I（ol）：0.024 A工作模式：SYNCHRONOUS
湿度敏感等级：3位数：4
功能数量：1端子数量：16
最高工作温度：125 °C最低工作温度：-55 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP16,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：260电源：3.3 V
传播延迟（tpd）：17 ns认证状态：Not Qualified
座面最大高度：1.75 mm子类别：Counters
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：2.7 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30触发器类型：POSITIVE EDGE
宽度：3.9 mm最小 fmax：80 MHz
Base Number Matches：1

74LVQ161MTR 数据手册

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74LVQ161  
SYNCHRONOUS PRESETTABLE 4-BIT COUNTER  
■
HIGH SPEED:  
= 180 MHz (TYP.) at V = 3.3 V  
f
MAX  
CC  
■
■
COMPATIBLE WITH TTL OUTPUTS  
LOW POWER DISSIPATION:  
I
= 4 µA (MAX.) at T =25°C  
A
CC  
■
■
■
LOW NOISE:  
= 0.3V (TYP.) at V = 3.3V  
75Ω TRANSMISSION LINE DRIVING  
SOP  
TSSOP  
V
OLP  
CC  
CAPABILITY  
Table 1: Order Codes  
PACKAGE  
SYMMETRICAL OUTPUT IMPEDANCE:  
|I | = I = 12mA (MIN) at V = 3.0 V  
T & R  
OH  
OL  
CC  
■
■
PCI BUS LEVELS GUARANTEED AT 24 mA  
BALANCED PROPAGATION DELAYS:  
SOP  
74LVQ161MTR  
74LVQ161TTR  
TSSOP  
t
t
PLH  
PHL  
■
■
■
OPERATING VOLTAGE RANGE:  
(OPR) = 2V to 3.6V (1.2V Data Retention)  
PIN AND FUNCTION COMPATIBLE WITH  
74 SERIES 161  
reset, parallel load, count-up and hold. Four  
control inputs, Master Reset (CLEAR), Parallel  
Enable Input (PE) and Count Enable Carry Input  
(TE), determine the mode of operation as shown  
in the Truth Table. A LOW signal on CLEAR  
overrides counting and parallel loading and sets  
all outputs on LOW state. A LOW signal on LOAD  
overrides counting and allows information on  
Parallel Data Qn inputs to be loaded into the  
flip-flops on the next rising edge of CLOCK. With  
LOAD and CLEAR, PE and TE permit counting  
when both are high. Conversely, a LOW signal on  
either PE and TE inhibits counting. All inputs and  
outputs are equipped with protection circuits  
against static discharge, giving them 2KV ESD  
immunity and transient excess voltage.  
V
CC  
IMPROVED LATCH-UP IMMUNITY  
DESCRIPTION  
The 74LVQ161 is  
SYNCHRONOUS PRESETTABLE COUNTER  
fabricated with sub-micron silicon gate and  
double-layer metal wiring C MOS technology. It is  
ideal for low power and low noise 3.3V  
applications. It is a 4 bit binary counter with  
Asynchronous Clear.  
The circuit have four fundamental modes of  
operation, in order of preference: synchronous  
a
low voltage CMOS  
2
Figure 1: Pin Connection And IEC Logic Symbols  
Rev. 2  
1/14  
July 2004  
1234567...15

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