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74LVQ157SJ

更新时间: 2024-11-19 22:34:43
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 解复用器逻辑集成电路光电二极管
页数 文件大小 规格书
6页 83K
描述
Low Voltage Quad 2-Input Multiplexer

74LVQ157SJ 技术参数

是否Rohs认证: 符合生命周期:Obsolete
零件包装代码:SOIC包装说明:5.30 MM, EIAJ TYPE2, SOP-16
针数:16Reach Compliance Code:compliant
HTS代码:8542.39.00.01风险等级:5.23
Is Samacsys:N系列:LVQ
JESD-30 代码:R-PDSO-G16JESD-609代码:e3
长度:10.2 mm负载电容(CL):50 pF
逻辑集成电路类型:MULTIPLEXER最大I(ol):0.012 A
湿度敏感等级:1功能数量:4
输入次数:2输出次数:1
端子数量:16最高工作温度:85 °C
最低工作温度:-40 °C输出极性:TRUE
封装主体材料:PLASTIC/EPOXY封装代码:SOP
封装等效代码:SOP16,.3封装形状:RECTANGULAR
封装形式:SMALL OUTLINE包装方法:TUBE
峰值回流温度(摄氏度):260电源:3.3 V
Prop。Delay @ Nom-Sup:9 ns传播延迟(tpd):13 ns
认证状态:Not Qualified座面最大高度:2.1 mm
子类别:Multiplexer/Demultiplexers最大供电电压 (Vsup):3.6 V
最小供电电压 (Vsup):2 V标称供电电压 (Vsup):2.7 V
表面贴装:YES技术:CMOS
温度等级:INDUSTRIAL端子面层:Matte Tin (Sn)
端子形式:GULL WING端子节距:1.27 mm
端子位置:DUAL处于峰值回流温度下的最长时间:NOT SPECIFIED
宽度:5.3 mmBase Number Matches:1

74LVQ157SJ 数据手册

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May 1998  
74LVQ157  
Low Voltage Quad 2-Input Multiplexer  
General Description  
Features  
n Ideal for low power/low noise 3.3V applications  
The LVQ157 is a high-speed quad 2-input multiplexer. Four  
bits of data from two sources can be selected using the com-  
mon Select and Enable inputs. The four outputs present the  
selected data in the true (noninverted) form. The LVQ157  
can also be used as a function generator.  
n Guaranteed simultaneous switching noise level and  
dynamic threshold performance  
n Guaranteed pin-to-pin skew AC performance  
n Guaranteed incident wave switching into 75.  
Ordering Code:  
Order Number  
74LVQ157SC  
74LVQ157SJ  
Package Number  
M16A  
Package Description  
16-Lead (0.150" Wide) Small Outline Integrated Circuit, SOIC JEDEC  
16-Lead Molded Small Outline Package, SOIC EIAJ  
M16D  
Devices also available in Tape and Reel. Specify by appending suffix letter “X” to the ordering code.  
Logic Symbols  
Connection Diagram  
Pin Assignment  
for SOIC JEDEC and EIAJ  
DS011352-1  
IEEE/IEC  
DS011352-2  
Pin Descriptions  
Pin Names  
Description  
Source 0 Data Inputs  
Source 1 Data Inputs  
Enable Input  
I0a–I0d  
I1a–I1d  
E
S
Select Input  
Za–Zd  
Outputs  
DS011352-3  
© 1998 Fairchild Semiconductor Corporation  
DS011352  
www.fairchildsemi.com  

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型号 品牌 替代类型 描述 数据表
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完全替代

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